Xilinx推出整體設計工具套件ISE10.1

　　賽靈思公司推出其ISE® Design Suite10.1版。這一統一的整體解決方案為FPGA邏輯、嵌入式和DSP設計人員提供了賽靈思的整個(gè)設計工具產(chǎn)品線(xiàn)，其中的設計工具具有完全的互操作能力。ISE Design Suite 10.1版以平均運行速度快兩倍的特性極大地加快了設計實(shí)施速度。因此設計人員可以在一天時(shí)間里完成多次反復設計。今天的發(fā)布另外一個(gè)重要意義就是新版本采用了SmartXplorer 技術(shù), 這一技術(shù)專(zhuān)門(mén)為解決設計人員所面臨的時(shí)序收斂和生產(chǎn)力這兩大艱巨挑戰而開(kāi)發(fā)。SmartXplorer技術(shù)支持在多臺Linux主機上進(jìn)行分布式處理，可在一天時(shí)間里完成更多次實(shí)施過(guò)程。通過(guò)利用分布式處理和多種實(shí)施策略，性能可以提升多達38%。SmartXplorer技術(shù)同時(shí)還為用戶(hù)利用獨立的時(shí)序報告監控每個(gè)運行實(shí)例提供相應的工具，。

　　“ISE Design Suite 10.1對我們的設計團隊來(lái)說(shuō)非常重要，運行時(shí)間改善了多達80%。更快的運行速度巨大地節約了開(kāi)發(fā)時(shí)間，因而也加快了我們的產(chǎn)品上市速度。”富士公司光學(xué)系統部高級工程師Yasuhiro Ooba說(shuō)。富士公司光學(xué)系統部是為全球市場(chǎng)提供信息技術(shù)和通信解決方案的領(lǐng)先供應商。

　　“SmartXplorer為我們的FPGA設計流程提供了強大的助力。沒(méi)有SmartXplorer技術(shù)的時(shí)候，我們必須手工登錄到多臺服務(wù)器并管理每個(gè)PAR任務(wù)。”數據中心I/O可視化領(lǐng)域的技術(shù)領(lǐng)導廠(chǎng)商 Xsigo Systems公司的邏輯設計人員Honda Yang說(shuō)，“我為所看到的不同策略實(shí)現的結果而驚訝“利用SmartXplorer， 我們在性能上加快了20%。”

　　PlanAhead Lite和基于策略的實(shí)施方法實(shí)現終極生產(chǎn)力

　　ISE® Foundation™中PlanAhead Lite工具的應用，為用戶(hù)提供了屢獲殊榮的PlanAhead設計和分析工具所擁有的強大布局規劃和分析功能的一個(gè)子集。免費提供的PlanAhead Lite采用了革命性的PinAhead技術(shù)。這一直觀(guān)的解決方案旨在簡(jiǎn)化管理目標FPGA和PCB之間接口的復雜性。PinAhead技術(shù)支持在設計較早階段智能實(shí)現引腳定義，從而避免了通常在設計后期發(fā)生的與引腳布局相關(guān)的修改。這種修改過(guò)去通常必須通過(guò)交互式引腳布局才能完成設計規模檢查。在PinAhead工具中，引腳分配完成后，還可以使用逗號分割值(CSV)文件或通過(guò)VHDL或Verilog頭文件輸出I/O端口信息。

　　ISE Design Suite10.1的推出還進(jìn)一步簡(jiǎn)化了確定最優(yōu)實(shí)現設置的過(guò)程?，F在設計人員還可規定和設置自己獨特的設計目標，可以是性能最大、優(yōu)化器件利用、降低動(dòng)態(tài)功耗、或者是實(shí)施時(shí)間最短。利用這一資源面積優(yōu)化策略，邏輯資源利用情況平均可節約10%。

　　廣泛聯(lián)合提供更好的驗證能力

　　ISE Design Suite 10.1還同時(shí)受益于賽靈思公司與業(yè)界領(lǐng)先的EDA供應商之一Mentor GraphICs公司的聯(lián)合協(xié)作。通過(guò)使用IEEE IP加密模型，ISE Design Suite 10.1的運行速度最快可達原來(lái)的兩倍。新的性能優(yōu)化BRAM, DSP和 FIFO仿真模型進(jìn)一步將RTL仿真運行時(shí)間縮短了一倍。

　　第二代XPower提供更強的功率分析和優(yōu)化功能

　　業(yè)界研究表明，滿(mǎn)足功率預算是FPGA設計人員面臨的一項越來(lái)越大的挑戰，特別是工藝幾何尺寸的不斷縮小進(jìn)一步加劇了這一問(wèn)題。ISE Design Suite 10.1為用戶(hù)提供了在設計過(guò)程中盡早分析功率要求的功能，同時(shí)還可以在設計過(guò)程中優(yōu)化動(dòng)態(tài)功率。

　　第二代XPower功率分析工具提供了改善的用戶(hù)接口，按照模塊、結構層次、電源軌和使用的資源分析功率更為容易，因此進(jìn)一步增強了功率估算功能。信息可以文本和HTML報告格式給出。與其它邏輯供應商提供的靜態(tài)估算網(wǎng)頁(yè)相比，這是一項巨大進(jìn)步，同時(shí)在提供準確的功耗信息方面是一個(gè)飛躍。

　　ISE Design Suite 10.1提供了便捷全面的功率優(yōu)化功能。利用集成的“功率優(yōu)化設計目標”功能，用戶(hù)可以簡(jiǎn)單地一步完成功率優(yōu)化流程。通過(guò)映射和布局布線(xiàn)算法的改進(jìn)，對于采用65nm Virtex®-5器件和Spartan™-3 Generation FPGA的設計動(dòng)態(tài)功率平均可降低10%和12%。

　　嵌入式設計和DSP設計工具集成

　　為幫助用戶(hù)更快速地實(shí)現優(yōu)化嵌入式和DSP設計，ISE Design Suite 10.1 還對賽靈思嵌入式和DSP工具進(jìn)行了進(jìn)一步的易用性改進(jìn)。例如統一的互操作性保證了用戶(hù)可以在ISE Design Suite 10.1 容易地增添System Generator模塊。EDK 和 System Generator for DSP技術(shù)之間不同工具的集成得到進(jìn)一步增強，從而能夠為同時(shí)涉及嵌入式和信號處理的更復雜FPGA SoC設計提供支持。

　　價(jià)格和供貨情況

　　ISE Design Suite 10.1 包括 ISE Foundation、嵌入式開(kāi)發(fā)套件 (EDK)、System Generator for DSP、 AccelDSP™綜合工具、ChipScope™ Pro 分析儀和ChipScope Pro Serial I/O 工具、 PlanAhead設計和分析工具以及ISE仿真器。用戶(hù)可以通過(guò)購買(mǎi)DVD或網(wǎng)絡(luò )下載方式安裝領(lǐng)域專(zhuān)用的DSP、嵌入式和邏輯設計產(chǎn)品。利用電子交付流程做為主要的產(chǎn)品提供方法，因此用戶(hù)不僅可以獲得所購買(mǎi)的產(chǎn)品，還可以快速獲得賽靈思其它設計工具的評估版本。

　　ISE Design Suite 10.1中的所有產(chǎn)品立即可以提供，價(jià)格從495美元至 2495美元不等。全功能60天評估版本可以從賽靈思網(wǎng)站免費下載。有關(guān)ISE Design Suite 10.1的更多信息，請訪(fǎng)問(wèn)www.Xilinx.com/cn/ISE。