一種基于SoPC的低應變反射波檢測系統

　　根據系統結構需求，IP核的設計如下：

　　NiosⅡ/經(jīng)濟型軟核處理器：SoPC Builder中包含三種可選的軟核處理器[4]。NiosⅡ/經(jīng)濟型軟核處理器具備最小的體積，完全能滿(mǎn)足本設計的應用需求。

　　片上存儲器：EP2C8 FPGA提供165 888 bit的RAM內存，共計36個(gè)M4k的存儲塊。

　　定時(shí)器模塊提供了系統所需的時(shí)鐘中斷。

　　并行輸入輸出模塊（PIO）通過(guò)2 bit的二進(jìn)制信號來(lái)控制濾波器的截止頻率，并負責檢測觸發(fā)信號。

　　串行外設接口（SPI）作為從屬設備來(lái)與模數轉換器通信。

　　通用異步收發(fā)器（UART）提供了人機交互接口。反射波數據經(jīng)過(guò)采集和調制后，可以通過(guò)USB-UART轉換芯片CP2102將其由SoPC模塊上傳至電腦做進(jìn)一步的處理。這里，USB接口可被視作一個(gè)虛擬的通用異步收發(fā)器來(lái)訪(fǎng)問(wèn)。

　　LCD模塊用來(lái)控制分辨率為320×240的液晶觸摸屏，其參數可自行定制。

　　EPCS、CFI和SDRAM控制器的作用是控制外圍擴展存儲器。EPCS控制器在系統啟動(dòng)時(shí)從EPCS4（串行配置芯片）下載硬件配置文件到FPGA。CFI（通用閃存接口）控制器具備32 Mb的Avalon接口（S29AL032），SDRAM控制器同樣也具備64 Mb的Avalon接口，為訪(fǎng)問(wèn)存儲器提供了便利。系統運行中,閃存存儲配置文件，而SDRAM存儲各類(lèi)數據。

　　所有的模塊將由用戶(hù)或SoPC Builder指派不同的地址。NiosⅡ處理器通過(guò)Avalon總線(xiàn)訪(fǎng)問(wèn)這些模塊或外部設備。

　　3.2 信號采集模塊

　　選擇用于低應變反射波檢測系統的加速度傳感器，必須使其與小錘在敲擊后產(chǎn)生的反射波的頻率匹配。一般來(lái)說(shuō),用于基樁無(wú)損檢測的有效信號頻率為0~2 kHz，加速度傳感器LC0104T正好滿(mǎn)足這個(gè)條件，其敏感度為100 mV/g，量程為50 g，且頻率范圍達到9 kHz，安裝諧振點(diǎn)為27 kHz?；赟oPC的信號采集模塊信道噪聲低，精度高，如圖4。

　　加速度傳感器的輸出端與20 kΩ的電阻并聯(lián)，將電流信號轉換成毫伏級的電壓信號。在信號傳輸過(guò)程中，用二階有源巴特沃斯低通濾波器來(lái)優(yōu)化信號，并過(guò)濾掉高頻噪聲。NiosⅡ通過(guò)PIO可以控制4個(gè)可編程中斷的頻率，分別是500 Hz、1 kHz、2 kHz和4 kHz。

　　AD7764是一種高性能、高速率、24位的Σ-Δ型A/D轉換器，融合了寬輸入帶寬、高速率的特性，312 kHz輸出數據速率時(shí)動(dòng)態(tài)范圍為109 dB，并且與FPGA有著(zhù)靈活的SPI接口(SCO、nFSO、SDO、SDI)。FPGA中50 MHz的外部時(shí)鐘信號可通過(guò)鎖相環(huán)分頻輸出20 MHz時(shí)鐘信號,以此驅動(dòng)AD7764的MCLK,并使A/D轉換器的nRESET端口在每個(gè)MCLK時(shí)鐘周期中被置低,這樣，NiosⅡ就可以通過(guò)SPI從模塊讀取包括24位轉換數據的32位信號。

　　為了記錄整個(gè)波形,低應變反射波的采樣流程如下：通過(guò)LCD觸摸屏發(fā)出采集信號指令，當觸發(fā)器偵測到通過(guò)濾波器的輸入信號的電壓達到閾值電壓時(shí)，便傳送給NiosⅡ處理器一個(gè)低電平到高電平的跳變信號,NiosⅡ處理器馬上記錄此閾值電壓信號的存儲地址。A/D轉換器開(kāi)始捕獲1 024個(gè)采樣的輸入信號，NiosⅡ將24位轉換數據寫(xiě)入外部閃存S29AL032中。最終，通過(guò)對加速度傳感器的數據處理，整個(gè)波形就可以用多個(gè)這樣的存儲地址中的數據，通過(guò)式(3)復原。