基于網(wǎng)絡(luò )編碼的多信源組播通信系統，包括源代碼，原理圖等 (三)

信號名稱(chēng)

位寬bits

I/O

描述

in_rdy

1

O

數據輸出輸入允許信號

out_data

64

I

輸入的數據包的data_bus

out_ctrl

8

I

輸入數據包的ctrl_bus

data_vld

1

I

輸入數據有效

rd_dcod_reg_req_0

1

O

讀取解碼標志位請求

rd_dcod_src_gen_0

12

O

要讀取的數據包的信源號和代編號

req_ack_vld_0

1

I

輸入有效

alredy_decod_0

1

I

解碼標志（“1”代表已經(jīng)解碼，“0”代表未解碼）

Uncod_data

64

O

未編碼數據包的數據總線(xiàn)

Uncod_ctrl

8

O

未編碼數據包的控制總線(xiàn)

Wr_vld

1

O

寫(xiě)capsulation數據有效

Out_rdy

1

I

輸出capsulation允許信號

fwd_rdy

1

I

輸出fwd_sel允許信號

out_vld

1

O

輸出fwd_sel有效

pay_load

64

O

輸出fwd_sel數據（不含包頭）

eop

4

O

最后指示一個(gè)有效字節的指示

uncod

1

O

指明輸出的數據包是否編碼

src_gen_num

12

O

Decoder接收到的數據包的信源號和代的編號

len_0

16

O

被編碼的第一個(gè)數據包的有效載荷的長(cháng)度

len_1

16

O

被編碼的第二個(gè)數據包的有效載荷的長(cháng)度

coef_0

8

O

被編碼的第一個(gè)數據包的編碼系數

coef_1

8

O

被編碼的第二個(gè)數據包的編碼系數

hp_info_vld

1

O

輸出信息有效

encod_pkt_trans_fi

1

O

編碼數據包傳輸完畢標志

oc_info_vld

1

I

解碼控制輸入信息有效

uncod_pkt_need

1

I

未編碼的數據包是/否解碼因子（1=是，0=否）

信號名稱(chēng)

位寬bits

I/O

信號描述

fwd_rdy

1

O

輸入fwd_sel允許信號

out_vld

1

I

輸入fwd_sel有效

pay_load

64

I

輸入fwd_sel數據總線(xiàn)（不含包頭）

eop

4

I

最后指示一個(gè)有效字節的指示

uncod

1

I

指明輸出的數據包是否編碼

wr_req

1

O

寫(xiě)RAM請求

encod_data

72

O

寫(xiě)RAM的數據總線(xiàn)

ram_data_vld

1

O

數據有效

encod_data_eop

4

O

數據包結束標志，指明最后一個(gè)有效字節

wr_ack

1

I

寫(xiě)RAM響應

uncod_data_vld

1

O

輸出至dcod_operation的數據有效

uncod_data_factor

64

O

輸出至dcod_operation的數據總線(xiàn)

uncod_data_eop

4

O

數據包結束標志，指明最后一個(gè)有效字節

dcod_rdy

1

I

輸出至dcod_operation允許信號

fd_back_ack

1

O

接受反饋?lái)憫?/p>

fd_back_vld

1

I

反饋數據有效標志

fd_back_req

1

I

反饋請求

fd_back_data

64

I

反饋數據總線(xiàn)

fd_back_data_eop

4

I

反饋數據結束標志，指明最后一個(gè)有效字節

信號名稱(chēng)

位寬bits

I/O

信號描述

wr_req

1

I

寫(xiě)RAM請求

encod_data

72

I

寫(xiě)RAM的數據總線(xiàn)

ram_data_vld

1

I

數據有效

encod_data_eop

4

I

數據包結束標志，指明最后一個(gè)有效字節

wr_ack

1

O

寫(xiě)RAM響應

wr_ram_num

2

I

要寫(xiě)入的RAM號

info_vld

1

I

數據有效標志

req_ram_num

1

O

讀RAM號請求

rd_ram_num

2

I

需要讀取數據的RAM號

rd_req

1

I

讀RAM請求

ram_data_eop

4

O

數據包結束標志，指明最后一個(gè)有效字節

ram_data

72

O

讀RAM的數據總線(xiàn)

ram_vld

1

O

讀RAM數據有效

信號名稱(chēng)

位寬bits

I/O

信號描述

Pkt_vld

1

I

要解碼的數據包輸出有效標志

Pkt_decoding

12

I

正在解碼的數據包的信源號、代編號

Decod_com

1

O

數據包解碼完成標志

has_other_factor

1

I

有另外一個(gè)解碼因子

Pkt_not_find

1

I

所需要解碼數據包未找到

pkt_need_src_gen

12

O

解碼需要的數據包

need_pkt_vld

1

O

所需數據包有效

src_gen_num

12

I

Decoder接收到的數據包的信源號和代的編號

len_0

16

I

被編碼的第一個(gè)數據包的有效載荷的長(cháng)度

len_1

16

I

被編碼的第二個(gè)數據包的有效載荷的長(cháng)度

coef_0

8

I

被編碼的第一個(gè)數據包的編碼系數

coef_1

8

I

被編碼的第二個(gè)數據包的編碼系數

hp_info_vld

1

I

輸入信息有效

encod_pkt_trans_fi

1

I

編碼數據包傳輸完畢標志

oc_info_vld

1

O

解碼控制輸出信息有效

uncod_pkt_need

1

O

未編碼的數據包是/否解碼因子（1=是，0=否）

wr_ram_num

2

O

要寫(xiě)入的RAM號

info_vld

1

O

數據有效標志

req_ram_num

1

I

讀RAM號請求

rd_info_req

1

I

讀取解碼信息請求

dcod_info_vld

1

O

解碼信息有效

ram_num

2

O

解碼數據包的所存儲的RAM號

coef_mut

8

O

乘法系數

coef_div

8

O

除法系數

cap_info_req

1

I

封裝信息請求

dcod_comp

1

I

解碼封裝完成

cap_info_vld

1

O

封裝信息有效

need_feed_back

1

O

需要反饋

pkt_len

16

O

數據包長(cháng)度

src_num

4

O

數據包的信源號

gen_num

8

O

數據報的代編號

信號名稱(chēng)

位寬bits

I/O

信號描述

dcod_payload

64

O

解碼后的數據包的有效載荷

end_payload

4

O

數據包結束標志，指明最后一個(gè)有效字節

payload_vld

1

O

輸出數據有效

wr_rdy

1

I

輸出數據允許信號

uncod_data_vld

1

I

輸入至dcod_operation的數據有效

uncod_data_factor

64

I

輸入至dcod_operation的數據總線(xiàn)

uncod_data_eop

4

I

數據包結束標志，指明最后一個(gè)有效字節

dcod_rdy

1

O

輸入至dcod_operation允許信號

rd_ram_num

2

O

需要讀取數據的RAM號

rd_req

1

O

讀RAM請求

ram_data_eop

4

I

數據包結束標志，指明最后一個(gè)有效字節

ram_data

72

I

讀RAM的數據總線(xiàn)

ram_vld

1

I

讀RAM數據有效

rd_info_req

1

O

讀取解碼信息請求

dcod_info_vld

1

I

解碼信息有效

ram_num

2

I

解碼數據包的所存儲的RAM號

coef_mut

8

I

乘法系數

coef_div

8

I

除法系數

信號名稱(chēng)

位寬bits

I/O

信號描述

decoder_in_rdy

1

I

輸出至SRAM允許信號

decoder_in_wr

1

O

輸出有效

decoder_in_data

64

O

輸出至SRAM數據總線(xiàn)

decoder_in_ctrl

8

O

輸出至SRAM控制總線(xiàn)

set_req

1

O

置位請求

set_src_gen

12

O

需要置位的數據包（表示已經(jīng)解碼完畢）

set_info_vld

1

O

置位信息有效

set_ack

1

I

置位請求響應

cap_info_req

1

O

封裝信息請求

dcod_comp

1

O

解碼封裝完成

cap_info_vld

1

I

封裝信息有效

need_feed_back

1

I

需要反饋

pkt_len

16

I

數據包長(cháng)度

src_num

4

I

數據包的信源號

gen_num

8

I

數據報的代編號

dcod_payload

64

I

解碼后的數據包的有效載荷

end_payload

4

I

數據包結束標志，指明最后一個(gè)有效字節

payload_vld

1

I

輸入數據有效

wr_rdy

1

O

輸入數據允許信號

fd_back_ack

1

I

接受反饋?lái)憫?/p>

fd_back_vld

1

O

反饋數據有效標志

fd_back_req

1

O

反饋請求

fd_back_data

64

O

反饋數據總線(xiàn)

fd_back_data_eop

4

O

反饋數據結束標志，指明最后一個(gè)有效字節

Uncod_data

64

I

未編碼數據包的數據總線(xiàn)

Uncod_ctrl

8

I

未編碼數據包的控制總線(xiàn)

Wr_vld

1

I

寫(xiě)capsulation數據有效

Out_rdy

1

O

輸入數據包允許信號

信號名稱(chēng)

位寬bits

I/O

信號描述

decoder_in_rdy

1

O

寫(xiě)SRAM控制器允許信號

decoder_in_wr

1

I

輸入有效

decoder_in_data

64

I

輸入至SRAM控制器數據總線(xiàn)

decoder_in_ctrl

8

I

輸入至SRAM控制器控制總線(xiàn)

reset_req

1

O

復位請求

reset_src_gen

12

O

需要復位的數據包（表示解碼后已發(fā)送完畢）

reset_info_vld

1

O

復位信息有效

reset_ack

1

I

復位請求響應

dcod_data_0

64

O

輸出的IP數據包的數據總線(xiàn)

dcod_ctrl_0

8

O

輸出的IP數據包的控制總線(xiàn)

wr_vld_0

1

O

輸出有效

wr_rdy_0

1

I

發(fā)送數據允許標志

sram_addr

19

O

Sram讀/寫(xiě)地址

sram_we

1

O

Sram寫(xiě)使能

sram_bw

4

O

SRAM寫(xiě)入控制信號

sram_wr_data

36

O

SRAM寫(xiě)數據總線(xiàn)

sram_rd_data

36

I

SRAM讀數據總線(xiàn)

sram_tri_en

1

O

SRAM寫(xiě)三態(tài)控制