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基于NoisⅡ的程控數字信號源設計

作者： 時(shí)間：2012-04-24 來(lái)源：網(wǎng)絡(luò ) 收藏

1．2 AD9854信號產(chǎn)生單元
AD9854的DDS核具有48位的頻率分辨率。輸出的信號頻率最高達150 MHz、頻率分辨率可達1μHz。將AD9854的8位數據線(xiàn)、5位地址線(xiàn)以及一些控制信號線(xiàn)(復位、寄存器數據更新引腳、FSK引腳等)引出連接到FPGA的通用I／O口上，使得FPGA可以完成對AD9854的相關(guān)配置與控制。AD9854的時(shí)鐘輸入采用了差分時(shí)鐘輸入形式。
1．3 人機交互界面
本單元由液晶顯示單元和PS／2鍵盤(pán)輸入單元組成。液晶單元采用ILI9320片上系統(SoC)驅動(dòng)器。有18位數據線(xiàn)，采用了16 b總線(xiàn)寬度的i80-systemMPU接口，PWM為液晶背光亮度調節引腳；RS為寄存器選擇信號，低電平選擇索引或狀態(tài)寄存器，高電平選擇控制寄存器；f.jpg為芯片片選信號，低電平使能；g.jpg為讀選通信號，低電平時(shí)讀出數據；h.jpg為寫(xiě)選通信號，低電平時(shí)寫(xiě)入寄存器數據。PS／2是一種雙向同步串行通信協(xié)議，通過(guò)Clock時(shí)鐘數據同步被讀入。

2 系統軟件設計
NoisⅡ軟核CPU是整個(gè)系統的控制部分，集成在FPGA內部，由SoPC Builder定制。將需要的IP組合在一起，設定各組件的地址和中斷優(yōu)先級，各IP Core通過(guò)Avalon總線(xiàn)邏輯互連，自由配置處理器的CACHE大小、指令集ROM大小、片內RAM和ROM大小、I／O引腳數目和類(lèi)型、中斷引腳數目、定時(shí)器數目、通用串口數目、擴展地址和數據引腳等處理器的性能指標。NoisⅡ集成開(kāi)發(fā)環(huán)境提供了創(chuàng )建C／C++應用工程的向導、管理和編譯工程功能、運行和調試程序功能和最終程序的FLASH的燒寫(xiě)。編程采用C語(yǔ)言。
系統首先進(jìn)行初始值，然后顯示開(kāi)機系統界面，軟核CPU接收到鍵盤(pán)中斷輸入的顯示信號和向AD9854輸出指令后，啟動(dòng)顯示和輸出程序模塊，使AD9854產(chǎn)生響應的信號輸出。對設置數據進(jìn)行存儲防止設置信息掉電丟失。整體程序設計流程如圖3所示。
2．1 AD9854驅動(dòng)程序
(1)AD9854主要負責各種波形信號的產(chǎn)生，采用并行模式，其程序框圖如圖4所示。

本文引用地址：http://dyxdggzs.com/article/190480.htm

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關(guān)鍵詞： Nois 程控數字 信號源

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