基于A(yíng)D6620的數字下變頻(DDC)的頻率變換器
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時(shí)間：2010-11-19
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AD6620的控制接口分串行輸入和并行輸入兩種。由于使用FPGA做芯片配置邏輯，所以，本文選用較靈活、效率較高的并行數據作為配置接口的邏輯輸入。
AD6620內部各個(gè)模塊的配置寄存器并不是等位長(cháng)的。具體各模塊內部配置寄存器的位長(cháng)見(jiàn)表l所列，而內部寄存器的訪(fǎng)問(wèn)則必須通過(guò)外部接口寄存器來(lái)指定地址，并由高位到低位按字節寫(xiě)入。
外部接口寄存器的位長(cháng)是固定的，按000到lll編址總共八個(gè)。其中低5位的5個(gè)寄存器是數據寄存器，可用于放入內部某地址的不定長(cháng)數據。而高兩位的兩個(gè)寄存器是地址寄存器，用于存放將要訪(fǎng)問(wèn)的內部寄存器的目標地址，其中最高位111寄存器又和模式控制寄存器復用，且其最高兩位標識為寫(xiě)增長(cháng)和讀增長(cháng)，具體結構如表2所列。
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