Delta-Sigma A／D轉換器原理及其PSpice仿真

摘要：為了深入理解Delta-Sigma A／D轉換器的工作原理，合理地使用這類(lèi)A／D轉換器產(chǎn)品，或者用FPGA實(shí)現自己的Delta-Sigma A／D轉換器設計。采用PSpice仿真軟件進(jìn)行模擬仿真的方法，對不同幅度的輸入信號進(jìn)行了一階Delta-Sigma A／D轉換器仿真實(shí)驗，獲得了與理論相一致的結果。通過(guò)對元件的參數掃描仿真為實(shí)際電路設計中元件的選擇提供了實(shí)驗依據。仿真實(shí)驗過(guò)程完整，易于重復，與純數學(xué)推導相比，仿真具有直觀(guān)的特點(diǎn)。
關(guān)鍵詞：Delta-Sigma；A／D轉換器；過(guò)采樣；PSpice仿真

0 引言
Delta-Sigma A／D轉換器具有高分辨率、高集成度、成本低和使用方便的特點(diǎn)，近年來(lái)，因數字化產(chǎn)品對高分辨率A／D，D／A轉換器需求的激增而得到廣泛地應用。Delta-Sigma A／D轉換器的構想出現已有很多年了，早期因受集成電路制造技術(shù)的限制，未在產(chǎn)品中廣泛使用，隨著(zhù)集成電路制造成本不斷降低，該技術(shù)的應用漸多，目前已成為高精度ADC的主流技術(shù)。隨著(zhù)該技術(shù)的趨熱，有更多人想了解其工作原理，但目前國內的教材對其涉及還不多，期刊論文多側重數學(xué)演繹，文獻中未見(jiàn)有詳盡的仿真實(shí)例。
除了制造專(zhuān)用ADC，該技術(shù)還易于用FPGA實(shí)現，邏輯電路可以完全集成在FPGA內部，只需要很少的外圍元件，就可以用FPGA直接進(jìn)行混合信號處理。由于FPGA可擴展和可重配置的特性，特別適合產(chǎn)品研發(fā)和小規模生產(chǎn)的場(chǎng)合，另外用FPGA在單一芯片上實(shí)現多路Sigma-Delta A ／D轉換也很容易。
Delta-Sigma有時(shí)稱(chēng)其為Sigma-Delta，或∑-△。

1 Delta-Sigma A／D轉換器原理
在△-∑A／D轉換器中，模擬輸入電壓信號被連接到一個(gè)積分器的輸入端。在輸出端對應輸入大小產(chǎn)生一個(gè)電壓變化率，或者斜坡。然后用比較器將該斜坡電壓與地電位(0V)進(jìn)行比較。比較器的行為就像1位A／D轉換器，根據積分器的輸出是正或負產(chǎn)生1位的輸出(“高”或“低”)。比較器的輸出通過(guò)一個(gè)以很高頻率時(shí)鐘驅動(dòng)的D觸發(fā)器被鎖存，并且反饋到積分器的另一個(gè)輸入通道，向0V方向趨勢驅動(dòng)積分器?；倦娐啡鐖D1所示。

在圖1中，最左邊的運放是積分器。積分器饋入的下一個(gè)運放是比較器，或1位A／D轉換器。接下來(lái)是D觸發(fā)器，在每個(gè)時(shí)鐘脈沖鎖存比較器的輸出，發(fā)送“高”或“低”信號到電路頂部的下一個(gè)比較器。最后這個(gè)比較器用于轉換信號極性，將觸發(fā)器的0 V／5 V邏輯電平輸出轉換到V+／V-電壓信號再反饋到積分器。
如果積分器輸出是正，第一次比較器將輸出一個(gè)“高”信號給觸發(fā)器的D輸入。在下一個(gè)時(shí)鐘脈沖，“高”信號將從Q線(xiàn)輸出到最后一個(gè)比較器的放大器輸入。最上面的那個(gè)比較器將看見(jiàn)一個(gè)輸入電壓大于+1／2 V的閾值電壓，它向正方向飽和，發(fā)送一個(gè)滿(mǎn)V+信號到積分器的另一個(gè)輸入端。這個(gè)V+反饋信號向負方向驅動(dòng)積分器輸出。如果輸出電壓一直為負，反饋環(huán)將發(fā)送一個(gè)矯正信號(V-)回到積分器的頂部輸入，向正方向驅動(dòng)它。這就是△-∑行為的概念：第一個(gè)比較器感知在積分器輸出和0 V電壓之間的差(△)，積分器求模擬輸入信號與最上面比較器輸出的和(∑)。

2 PSpice仿真
通過(guò)PSpice仿真模擬實(shí)驗，可以更容易和更清楚地理解△-∑A／D轉換器的工作原理。下面采用PSpiee仿真△-∑A／D轉換器。本文使用CaptLire CIS Lite Edition 9．2繪制電路圖，用PSpice Lite Version 9．2進(jìn)行仿真。