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基于CAN核的四冗余通信板設計與仿真

作者： 時(shí)間：2010-02-02 來(lái)源：網(wǎng)絡(luò ) 收藏
隨著(zhù)電子技術(shù)、計算機應用技術(shù)和EDA技術(shù)的不斷發(fā)展，利用FPGA進(jìn)行數字系統的開(kāi)發(fā)已被廣泛應用于通信、航天、醫療電子、工業(yè)控制等領(lǐng)域，FPGA成為當今硬件設計的首選方式之一。PC／104是一種專(zhuān)門(mén)為嵌入式控制而定義的工業(yè)控制總線(xiàn)，以其獨特的堆棧式結構、低功率等優(yōu)點(diǎn)，得到了廣泛的應用。作為主流的現場(chǎng)總線(xiàn)，工業(yè)控制局域網(wǎng)CAN(Controller Area Network)總線(xiàn)抗干擾能力強，易于組網(wǎng)，具有非常廣闊的應用前景。獨特的PC／104總線(xiàn)與CAN總線(xiàn)的結合，進(jìn)一步拓寬了CAN總線(xiàn)的應用領(lǐng)域。

1基于FPGA的CAN核設計

本設計采用了Altera公司的Cyclone III系列FPGA EP3C25，開(kāi)發(fā)平臺采用了Altera公司的Quartus II軟件。CAN核的設計以SJA1000功能結構為基礎。

CAN核的功能框圖如圖1所示。該CAN總線(xiàn)控制器IP核，遵循CANbus 2.0標準，其功能和寄存器操作與SJA1000兼容。IP核采用VHDL編碼，并采用容錯設計，可抑制存儲性器件的數據位翻轉，大大提高了IP核的可靠性。CAN核可在FPGA中實(shí)現，也可以實(shí)現為ASIC。其中包含3個(gè)主要模塊：寄存器組(can_registers)，位時(shí)序邏輯(can_btl)，位流處理器(can_bsp)。


寄存器組(CAN Register)：外部微處理器可以通過(guò)地址直接訪(fǎng)問(wèn)這些寄存器。發(fā)送數據時(shí)，微處理器將要發(fā)送的數據寫(xiě)入發(fā)送緩沖器，置位命令寄存器的發(fā)送請求位來(lái)啟動(dòng)發(fā)送。接收到數據后，核心控制器將其存在接收緩沖器，并通知位控制器將其取走。同時(shí)，CAN寄存器中還有1個(gè)64字節的接收FIFO，可以1次存儲至少2個(gè)數據幀。

位時(shí)序邏輯(BTL)：用來(lái)監視CAN總線(xiàn)并處理與CAN總線(xiàn)相關(guān)的位時(shí)序。在消息的開(kāi)始處，當位時(shí)序邏輯檢測到總線(xiàn)上由隱性位(recessive)到顯性位(dominant)的跳變時(shí)，就會(huì )將其內部邏輯同步到位流，稱(chēng)之為硬同步；隨后，在接收消息的過(guò)程中，檢測到隱性位到顯性位的跳變時(shí)，便會(huì )重同步到位流，稱(chēng)之為軟同步。位時(shí)序邏輯還要根據總線(xiàn)定時(shí)寄存器0和總線(xiàn)定時(shí)寄存器1的值來(lái)決定每個(gè)位周期采樣點(diǎn)的位置，以補償傳輸延遲和相位漂移所造成的誤差；同時(shí)，根據總線(xiàn)定時(shí)寄存器1的設置采取相應的采樣模式(單次采樣或3次)對總線(xiàn)上的數據采樣。

位流處理器(BSP)：根據其實(shí)現的功能分為3個(gè)模塊：數據接收模塊、數據發(fā)送模塊和錯誤處理模塊。數據接收模塊將從位時(shí)序邏輯送過(guò)來(lái)的采樣數據去除位填充后送到移位寄存器進(jìn)行串并轉換，之后對并行數據進(jìn)行CRC校驗，在消息接收完時(shí)發(fā)送應答信號，表示接收無(wú)誤。最后將接收到的消息的特征碼與驗收屏蔽寄存器的內容進(jìn)行比較，以決定是否將接收的消息寫(xiě)入接收FIFO。數據接收模塊將要發(fā)送的數據組成幀并進(jìn)行CRC計算，之后送入移位寄存器進(jìn)行并串轉換，然后將串行數據編碼(位填充)后送到總線(xiàn)上。錯誤監視模塊根據協(xié)議規范中描述的錯誤監視機制檢測系統錯誤，并設置相應的寄存器，通知設備控制器。模塊根據協(xié)議描述的12種錯誤監視規則，在適當情況下對計數器進(jìn)行加、減或清除?？刂破鞲鶕@兩個(gè)計數器的值以及錯誤限制寄存器的值來(lái)決定自己的故障狀態(tài)：錯誤激活(Error Active)，錯誤認可(Error Passire)或總線(xiàn)關(guān)閉(Bus off On)。

2硬件電路設計

根據系統的總體設計方案，因為現有的CAN總線(xiàn)收發(fā)器最大的工作頻率為1 MHz，在提高CAN的通信速度后，現有的CAN總線(xiàn)收發(fā)器就不能滿(mǎn)足需要了，因此改用RS485收發(fā)器。由于RS485收發(fā)器是差分傳輸，不能完成通信卡的自發(fā)自收功能，因此需要外置的CAN Hub。另外，要進(jìn)行光纖傳輸，要完成光的邏輯總線(xiàn)結構，也需要外置Hub。因此，本硬件設計分為CAN通信板的設計和CAN Hub的設計兩部分。
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關(guān)鍵詞： 仿真 設計 通信 CAN 基于

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