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基于Simulink的數控振蕩器性能仿真研究
作者：
時(shí)間：2010-03-24
來(lái)源：網(wǎng)絡(luò )
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提高LUTs輸出分辨率對正弦波樣點(diǎn)的幅度值量化影響小，但需要更多的LUTs存儲器。如LUTs輸出分辨率增加1位，由L位增加L+1位，LUTs所需的存儲容量擴大2n。
可見(jiàn)，采用傳統的設計方法要達到無(wú)相位截斷，則需要LUT的字長(cháng)非常長(cháng)，占用資源非常大，導致NCOs的成本很高，而這在實(shí)際實(shí)現過(guò)程中是不可行的。
2.3相位加抖提高SFDR
通過(guò)以上的仿真研究可看出，雖然可以通過(guò)增加整數位和提高LUTs輸出分辨率的方法來(lái)提高SFDR，但因它們要占用大量的資源，因而不是經(jīng)濟有效的方法。為有效解決雜波問(wèn)題，必須考慮其他有效的方法。目前的主要技術(shù)手段有：
幅度加抖(Amplitude Dithering)：在LUT的輸出中加入低水平的噪聲，以打散原有幅度值量化的噪聲結構。
相位加抖(Phase Dithering)：在累加器的輸出中加入低水平的噪聲，以打散原有相位截斷的噪聲結構。
帶通濾波(Bandpass Filtering)：在振蕩器輸出端加濾波器濾出毛刺頻率。但該方法很難濾出靠近中心頻率的雜波。
以上的仿真已經(jīng)證明，相位截斷對SFDR的影響量是最大的，是提高SFDR的首選方法。
相位加抖的數學(xué)模型如圖5所示。在LUTs地址字截斷之前，在累加器的輸出中加入低水平的偽隨機噪聲(A Low-level of Pseudo Random Noise)，其中抖動(dòng)的位數d是可變的。
抖動(dòng)(Dither)可以通過(guò)線(xiàn)性反饋移位寄存器(Linear Feedback Shift Register，LFSR)來(lái)實(shí)現，見(jiàn)圖6。LFSR有帶M個(gè)抽頭的移位寄存器，抽頭反饋通常由或門(mén)構成，以產(chǎn)生一個(gè)周期為2M-1的序列。因此，長(cháng)偽隨機噪聲序列(Long Pseudo Random Noise Sequences)可以用很少的硬件資源實(shí)現。例如，一個(gè)由12個(gè)元件構成的LFSR能夠生成周期為4 095的PN序列。LFSR可以由M個(gè)D觸發(fā)器和很少的組合器件構成。
來(lái)自某位的抽頭，可以組合為一個(gè)矢量生成該位的抖動(dòng)。實(shí)際實(shí)現時(shí)，可以采用較長(cháng)的移位寄存器。移位寄存器越長(cháng)，則輸出的抖動(dòng)越接近隨機的性質(zhì)。
下面分析相位加抖數據位數d對SFDR的影響。圖7～圖9分別為d=b-3，b+3，b三種情況的仿真波形，其中b為累加器控制字小數部分的位數。
加抖位數d=6-3時(shí)，僅對整數位產(chǎn)生0～1／8的影響。此時(shí)將SFDR提高了1 dB?？梢?jiàn)，增加過(guò)少位數的抖動(dòng)，僅對相位的截斷有很小的影響，對改變雜波極為有限。
加抖位數d=b+3時(shí)，可以對整數位產(chǎn)生0～8的影響。此時(shí)將SFDR提高了9 dB。但同時(shí)可以看到，由于增加抖動(dòng)的位數過(guò)多，雖然消除了雜波，但同時(shí)也提高了整個(gè)頻譜的噪聲電平。
加抖位數d=b時(shí)，可以對整個(gè)整數位產(chǎn)生0～1影響。此時(shí)將SFDR提高到106 dB。同時(shí)可以看到，由于增加抖動(dòng)的位數恰當，既消除了雜波，又提高了整個(gè)頻譜的噪聲電平。
在用FPGA實(shí)現NCOs時(shí)，通過(guò)相位加噪可以提高整個(gè)輸出頻率的SFDR性能。但從圖3，圖6比較可以看出，在整個(gè)電路中串入了加法器，且關(guān)鍵路徑包含了兩個(gè)部分Dithering和NCOs的加法器，因而限制了整個(gè)設計的最大時(shí)鐘頻率。
3結 語(yǔ)
NCOs在數字通訊中起著(zhù)非常重要的作用，在FPGA實(shí)現時(shí)，它可以由一個(gè)累加器和一個(gè)輸出頻率由步長(cháng)定義的正弦波查找表的數字硬件構成。SFDR是表明合成正弦波譜純度性能的參數。仿真證明，在NCOs累加器輸出的相位中加入抖動(dòng)，以提高SFDR性能，是一種簡(jiǎn)單有效、低成本的方法。
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