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機載數字視頻記錄系統的軟、硬件設計

作者: 時(shí)間:2004-12-11 來(lái)源:網(wǎng)絡(luò ) 收藏
摘要:通過(guò)嵌入式計算機PC104對MPEG A/V編碼芯片SZ1510進(jìn)行配置和控制,可以縮短研制高性能航空環(huán)境下式彩色儀的開(kāi)發(fā)時(shí)間。文中詳細介紹了該的軟、思想及注意事項。

關(guān)鍵詞:SZ1510;;PC104;新型飛機

視頻記錄在飛行員的日常訓練中發(fā)揮著(zhù)十分重要的作用。該可以實(shí)時(shí)記錄飛行器的飛行及訓練過(guò)程中的各種信息,能夠直觀(guān)、真實(shí)的反映飛行員在空中的飛行和操作情況。通過(guò)地面回放設備的回放,飛行員可以準確地把握自身的不足并及時(shí)改進(jìn),從而提高訓練水平。但由于視頻信號數據量大,技術(shù)要求高,國產(chǎn)飛機大多沒(méi)有信息監視和記錄系統。為了提高我軍戰機的作戰性能?研制一種信息監視和記錄系統迫在眉睫。

隨著(zhù)大規模集成電路的發(fā)展,采用圖像壓縮技術(shù)實(shí)現高壓縮比、高質(zhì)量的圖像數字壓縮記錄系統已成為可能。數字化的記錄方法可以將視頻數據經(jīng)過(guò)壓縮記錄在大容量的存儲器上,并能有效消除噪聲、增加記錄時(shí)間、加快拷貝和復制速度,快速回放和查找,同時(shí)還可以快速地通過(guò)計算機網(wǎng)絡(luò )進(jìn)行傳送?;谝陨显?,筆者為某新型飛機研制了高性能的適于航空機載環(huán)境的數字式彩色視頻記錄系統。本記錄系統的核心芯片選用以色列Zepax公司的SZ1510 MPEG-1編碼芯片。

1 工作原理

圖1所示是本記錄系統的結構組成示意圖。整個(gè)系統由三大部分組成,即壓縮控制部分、存儲部分和電源部分三大模塊。其中壓縮部分由一路MPEG-1音視頻壓縮電路和控制單元PC-104組成,主要功能是實(shí)現對輸入音視頻信號的數字壓縮。存儲部分由大容量硬盤(pán)組成,用于完成對壓縮數據的長(cháng)時(shí)間記錄。電源部分負責對各模塊電路提供電源。

在系統啟動(dòng)時(shí),主控計算機首先對壓縮卡進(jìn)行初始化,當設置好MPEG-1壓縮格式及數據速率后,壓縮卡開(kāi)始工作,并在主控計算機的控制下將壓縮后的圖像數據寫(xiě)入硬盤(pán)。在工作過(guò)程中,主控計算機還將不斷監視相關(guān)信號,并在圖像中加入相應的標志,直到接收到關(guān)機信號,系統自動(dòng)結束壓縮卡的工作,并關(guān)閉主機。

2 系統

整個(gè)系統的核心是以色列Zepax公司的SZ1510 MPEG-1編碼芯片,它由PC104控制,另外,該系統還包括PCI橋芯片PLX9030以及視頻解碼芯片SAA7113等。

2.1 SZ1510芯片簡(jiǎn)介

Zepax公司的SZ1510IC內部采用可編程的專(zhuān)業(yè)體系結構,它可以高效使用存儲器,并能合理進(jìn)行資源分配。內核采用TI公司的TMS320C54X高性能DSP來(lái)完成MPEG1音頻編碼、解碼以及CD格式的音/視頻流的組合,同時(shí)進(jìn)行一般的系統控制。

該芯片具有功能多、功耗小、溫度范圍寬等特點(diǎn),其組成電路如圖2所示。它主要由運動(dòng)估計與補償單元、DCT與反DCT變換單元、可變長(cháng)編碼單元、控制單元、SDRAM接口單元、通用總線(xiàn)接口單元組成。內部的壓縮處理完全采用流水線(xiàn)結構,開(kāi)機后只需簡(jiǎn)單的初始化即可獨立工作,同時(shí)自動(dòng)送出壓縮好的數據。外部電路的時(shí)鐘為27MHz,工作電壓為3.3V。

系統中的視頻壓縮有三種比特率可供選擇,其中恒定比特率需要填充冗余,最大比特率不需要填充冗余,而可變比特率的壓縮質(zhì)量比較恒定,但比特率可變。音頻壓縮部分支持3244.1及48kHz取樣率以及音頻PCM、實(shí)時(shí)MPEG12層音頻編碼等。

2.2 PC104計算機簡(jiǎn)介

考慮到控制單元的體積、可靠性和控制能力,可選用嵌入式計算機PC104作為主控單元。根據視頻壓縮的特點(diǎn),推薦選擇安普公司的AmproP5E/266產(chǎn)品,該產(chǎn)品溫度特性好、功能強大、可靠性高、軟硬件移植方便且易于調試。

3 軟件

SZ1510共有128個(gè)寄存器,每個(gè)寄存器都有一個(gè)索引號。外界對這些寄存器的訪(fǎng)問(wèn)都是通過(guò)IOAR?I/O Adress Register?和IODR(I/O Data Register)來(lái)完成的。訪(fǎng)問(wèn)時(shí)首先將這個(gè)寄存器的索引號寫(xiě)入IOAR?然后將要寫(xiě)的數據寫(xiě)入IODR,這樣,SZ1510即可自動(dòng)把數據送到某個(gè)寄存器。

主機訪(fǎng)問(wèn)SZ1510是通過(guò)PLX9030進(jìn)行的。對PLX9030中寄存器的訪(fǎng)問(wèn)通常是按內存方式進(jìn)行的,其方法是常規段加偏移方式。不過(guò),它的寄存器訪(fǎng)問(wèn)總線(xiàn)寬度有的是16bits(如0x4c),有的是32bits(如0x50),具體可參考有關(guān)文獻(5)。

3.1 硬件初始化

對系統硬件的初始化主要是初始化PLX9030和SZ1510。PLX9030的初始化比較簡(jiǎn)單,一是使能中斷,向寄存器0x4c中寫(xiě)入0x0041,二是對PLX9030的Local bus進(jìn)行軟復位,即先將寄存器0x50的第30位置1,再將其置0。

SZ1510的初始化過(guò)程如下:

(1)向中斷使能寄存器寫(xiě)入0x40,以使能Ready中斷;

(2)等待SZ1510的Ready中斷;

(3)等到Ready中斷后,向SZ1510的0x1E寄存器寫(xiě)入0x0A,設置它內部的DSP時(shí)鐘為94.5MHz;

(4)向0x013寄存器寫(xiě)入0x55,對SZ1510進(jìn)行軟復位;

(5) 向中斷使能寄存器0x0C寫(xiě)入0x40?使能Ready中斷;

(6) 等候RDY中斷;

(7) 待Ready中斷后對SAA7113進(jìn)行初始化;

(8) 對SZ1510進(jìn)行軟復位,即向0x0B寄存器寫(xiě)入0x55,同時(shí)向0x0C寄存器寫(xiě)入0x40;

(9) 等待Ready中斷,等到后向SZ1510的內部DSP裝載二進(jìn)制代碼;

(10)進(jìn)行SZ1510內部視頻壓縮核的二進(jìn)制代碼裝載。

3.2 SZ1510二進(jìn)制代碼的裝載

SZ1510 內部有一段程序空間,可用來(lái)裝載二進(jìn)制代碼。這段空間以塊(Blank)為單位,每塊的大小是256字節。

用于視頻編碼核的二進(jìn)制代碼的裝載空間為0x000~0x004和0x00c等六個(gè)塊,共1.5k字節代碼。具體裝載的步驟如下:

(1) 向0x2E寄存器寫(xiě)0x01,表示外部的SDRAM是1M16bits;

(2) 向0x0C寄存器寫(xiě)0x03,使能FIFO Ready 和 End of Data中斷;

(3) 向0x11寄存器寫(xiě)0x1,設定工作模式為內部?jì)却鎸?xiě)模式;

(4)向0x10寫(xiě)0x20,設定SZ1510?下轉第10頁(yè)?(上接第6頁(yè))輸出數據的FIFO大小為256字節;

(5)對每塊程序空間進(jìn)行二進(jìn)制代碼裝載,具體過(guò)程如下:

●向0x08寄存器寫(xiě)0x04,發(fā)送開(kāi)始命令;

●等待Ready中斷,清除Ready中斷;

●向Data in寄存器0x01寫(xiě)256個(gè)字節;

●等待End of Data中斷,然后清除中斷;

(6)查程序空間的代碼是否裝載完畢,如沒(méi)有,回到(5)繼續裝載。

3.3 SZ1510視頻數據的獲取

SZ1510內部有一個(gè)256字節的FIFO。一旦該FIFO滿(mǎn),即產(chǎn)生一個(gè)FIFO Ready中斷,以通知主機讀?。疲桑疲现械臄祿?,然后通過(guò)256次讀Data out寄存器來(lái)完成數據傳輸。

4 注意事項

SZ1510芯片的PLL PCB設計要求如下?

(1)應用設計EMI濾波裝置以減少VDDA的電源噪聲。

(2)LPF到SZ1510的整體電路管腳長(cháng)度應當小于0.5英寸。

(3)設計PCB時(shí),外部LPF應盡量接近封裝腳。

(4)VDDA和VSSA端應接0.1μF的旁路電容以減少噪音。



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