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基于DSP的圖像壓縮無(wú)線(xiàn)傳輸系統設計
作者：
時(shí)間：2010-03-12
來(lái)源：網(wǎng)絡(luò )
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4．2 DMA在JPEG算法中的應用
該系統采用JPEG壓縮算法，該算法是將圖像數據分成8x8的矩陣塊、離散余弦變換、量化、Z(Zigzag)形掃描和Huffman編碼，圖像數據JPEG壓縮時(shí)。需要分塊處理DSP外圍存儲器中的圖像數據。CPU對外圍存儲器的讀寫(xiě)操作要慢于內部DRAM存儲區。為提高圖像壓縮速度，在算法移植時(shí)，內部DARAM建立兩個(gè)8x8的矩陣單元，DMA將外部存儲器的圖像數據以8x8的矩陣塊為單元傳輸到到內部DARAM中的一個(gè)數組中，同時(shí)實(shí)現JPEG算法的分塊操作。利用DMA與CPU并行工作的特性，在CPU操作一個(gè)塊時(shí)，另一分塊傳輸數據，兩個(gè)數組交替進(jìn)行，構成乒乓結構。圖像壓縮過(guò)程中需多次配置DMA，才能實(shí)現整個(gè)圖像數據從外存到內存的傳輸和數據分塊。數據塊依次經(jīng)離散余弦變換、量化、Z變換及哈夫曼編碼，形成JPEG碼流。圖4為圖像壓縮的程序流程。
4．3 McBSP端口與無(wú)線(xiàn)模塊的連接
無(wú)線(xiàn)通信模塊nRF24L01通過(guò)SPI接口實(shí)現與DSP的數據通信，只需占用4根數據線(xiàn)且傳播速度快。DSP的MeBSP的時(shí)鐘停止模式與SPI協(xié)議兼容。當McBSF設置成時(shí)鐘停止模式時(shí)，發(fā)送器和應答器內部同步，McBSP就作為一個(gè)SPI主／從設備使用。系統中DSP的McBSP作為SPI的主設備，主要的McBSP控制寄存器位設置如下：
RPHASE=XPHASE=0，∥單相幀
RFRLEN1=XFRLEN=0，／每幀一個(gè)數據單元
RWDLEN1=XWDLEN1=000b，／／數據單元字長(cháng)8位
CLKRP=CLKXP=O，／／時(shí)鐘下降沿接收數據。在上升沿處發(fā)送數據
FSRP=FSXP=0，／／幀同步信號高有效
RDATDLY=XDATDLY=01b，／／1位數據延遲
通過(guò)此種方式實(shí)現與nRF24L01串行通信。DMA的寄存器配置和圖像數據傳輸的DMA配置可以參考圖像壓縮DMA的配置。
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