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RAM讀寫(xiě)時(shí)序限制解決方案

作者： 時(shí)間：2011-10-28 來(lái)源：網(wǎng)絡(luò ) 收藏
變換編碼后一個(gè)塊內的有效系數一般小于25，所以逆掃描、反量化的時(shí)鐘一般小于25個(gè)時(shí)鐘周期，而反變換的時(shí)鐘周期為22個(gè)，所以處理一個(gè)塊的時(shí)鐘周期大約為25個(gè)，大大提高了速度。由于寄存器的復用及設計的優(yōu)化，節省了硬件資源，本設計采用的FPGA為EP2C35F672C6，資源使用情況如圖7所示，可見(jiàn)使用的總的LE為3 059個(gè)。

本文引用地址：http://dyxdggzs.com/article/150086.htm

　　

　　本設計為了解決RAM讀寫(xiě)時(shí)序限制的影響，采用了兩組寄存器陣列代替RAM實(shí)現乒乓操作，同時(shí)為了減少硬件資源，采用寄存器組復用技術(shù)，即反變換中的轉置矩陣與逆掃描后存儲寄存器組復用。最后給出了波形仿真結果，并與rm52j的輸出結果比較，驗證了結果的正確性。通過(guò)在基于Nios II的SoPC系統上進(jìn)行測試，證明該設計能夠正確快速實(shí)現逆掃描、反量化及反變換功能。

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