基于ISP技術(shù)的電子鐘設計
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要求能啟動(dòng)或停止電子鐘運行，且能在電子鐘停止運行狀態(tài)下修改時(shí)、分、秒的值，可增加一個(gè)啟動(dòng)/停止控制端實(shí)現。如啟動(dòng)/停止控制端接低電平，分頻模塊的時(shí)鐘接1 kHz的連續脈沖，其他模塊分別接對應輸出，電子鐘便啟動(dòng)。而當啟動(dòng)/停止控制端接高電平，分頻模塊的時(shí)鐘接地，其他模塊的時(shí)鐘分別接3個(gè)單脈沖手動(dòng)輸入，電子鐘停止運行，手動(dòng)產(chǎn)生一個(gè)單脈沖，與其相連的模塊就計數一次，達到了修改時(shí)、分、秒的目的，即實(shí)現了電子鐘更改時(shí)間的功能。本文引用地址：http://dyxdggzs.com/article/148925.htm
3.3 ABEL語(yǔ)言描述
下面用ABEL語(yǔ)言的層次結構實(shí)現電子鐘的設計可分為頂層模塊Clock，3個(gè)底層模塊FP1000，FP60和FP24。下面介紹頂層模塊CLOCK，其中調用了3個(gè)底層模塊。
4 結 語(yǔ)
從上例可知，用ISP器件可進(jìn)行各種數字電路實(shí)驗，代替了古老的面模板實(shí)驗，而且靈活方便，是一種較理想的數字電路課程設計方法，值得推廣應用。
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