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EEPW首頁(yè) > 嵌入式系統 > 設計應用 > 多路同步串口的FPGA傳輸實(shí)現

多路同步串口的FPGA傳輸實(shí)現

作者：詹必勝 吳斌方 楊光友 湖北工業(yè)大學(xué) 時(shí)間：2010-03-02 來(lái)源：電子產(chǎn)品世界 收藏

本文引用地址：http://dyxdggzs.com/article/106466.htm

　　信號抗干擾處理

　　在FPGA和ARM之間的通訊中利用差分信號傳輸用于消除信號的干擾。差分對是指兩條線(xiàn)路總是傳送相反的邏輯電平，差分對信號對外界干擾源產(chǎn)生的噪聲不敏感，例如電路板的干擾噪聲等。
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