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mcu-fpga 文章 進(jìn)入mcu-fpga技術(shù)社區
基于FPGA系統易測試性的研究
- 引 言 現代科技對系統的可靠性提出了更高的要求，而FPGA技術(shù)在電子系統中應用已經(jīng)非常廣泛，因此FPGA易測試性就變得很重要。要獲得的FPGA內部信號十分有限、FPGA封裝和印刷電路板(PCB)電氣噪聲，這一切使得設計調試和檢驗變成設計中最困難的一個(gè)流程。另一方面，當前幾乎所有的像CPU、DSP、ASIC等高速芯片的總線(xiàn)，除了提供高速并行總線(xiàn)接口外，正迅速向高速串行接口的方向發(fā)展，FPGA也不例外。每一條物理鏈路的速度從600 Mbps到10 Gbps，高速I(mǎi)／O的測試和驗證更成為傳統專(zhuān)注于FPG
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汽車(chē)MCU性能不斷優(yōu)化 內核暗戰升級
- MCU可謂汽車(chē)電子化進(jìn)程中“當仁不讓”的主角。目前一部中端汽車(chē)采用的MCU數量大約是40-50片，而高端車(chē)型可達到80-100片。據IC-Insights預計，2008年全球車(chē)用MCU市場(chǎng)將達到66.2億美元，年復合平均成長(cháng)率為13%。 8位、16位和32位MCU各成其就 從目前的狀況來(lái)看，在汽車(chē)市場(chǎng)上，8位、16位和32位MCU都有一定的市場(chǎng)份額，因為針對不同的應用需要與之相應的不同性能的產(chǎn)品。英飛凌科技中國有限公司汽車(chē)工業(yè)及多元化電子市場(chǎng)事業(yè)部
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基于FPGA的UARTl6550的設計
- 1 引 言 UART(Universal Asynchronous Receiver/Transmitter，通用異步收發(fā)器)是用于控制CPU與串行設備通信的芯片，將由CPU傳送過(guò)來(lái)的并行數據轉換為輸出的串行數據流。將系統外部來(lái)的串行數據轉換為字節，供系統內部使用并行數據的器件使用。他可以在輸出的串行數據流中加人奇偶校驗位和啟停標記，并對從外部接收的數據流進(jìn)行奇偶校驗以及刪除啟停標記。常見(jiàn)UART主要有INS8250，PC16450和PCI6550，其中16550發(fā)送和接收都帶有16 B的FIFO
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FPGA的DSP性能揭秘
- “今天，FPGA越來(lái)越多地應用在多種DSP中。我們預計這一趨勢在未來(lái)幾年會(huì )更加明顯?！泵绹{查機構Berkeley設計技術(shù)公司做了上述預測。以Xilinx和Altera為主的兩大FPGA廠(chǎng)商多年前就涉足了DSP應用領(lǐng)域，近一、兩年，隨著(zhù)3G通信、視頻成像等領(lǐng)域的發(fā)展，FPGA for DSP(FPGA的DSP)再次成為了熱點(diǎn)。為什么會(huì )用FPGA做DSP？Xilinx中國區運營(yíng)總經(jīng)理吳曉東從DSP的概念上進(jìn)行了分析：DSP表示數字信號處理器，也可以表示為數字信號處理—并不代表某一種芯片。實(shí)際上，數字信號處理
- 關(guān)鍵字： 0706_A DSP FPGA 單片機 嵌入式系統 雜志_專(zhuān)題
FPGA for DSP的精彩問(wèn)答
- 問(wèn)：現在DSP跟微處理器結合的情況比較多，實(shí)現DSP功能的FPGA是否也要和微處理器合作？答：現在90%以上的FPGA都運用在處理器上，這也正是FPGA這方面的優(yōu)勢。你可以用FPGA的邏輯搭建一個(gè)軟處理器，也可以選用具有內嵌硬處理器的產(chǎn)品。因此，可以很容易在FPGA上實(shí)現微處理器的性能。 問(wèn)：FPGA已經(jīng)能夠實(shí)現DSP，為何還要專(zhuān)門(mén)開(kāi)發(fā)為DSP應用的FGPA？答：首先，所有的FPGA都有乘法器，如果你可以拿這些乘法器做數字信號處理，但是不是最優(yōu)化的。例如，如果你選擇Xilinx Spartan的產(chǎn)品，你
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基于FPGA的二值圖像連通域標記快速算法實(shí)現
- 摘 要：針對高速圖像目標實(shí)時(shí)識別和跟蹤任務(wù)，需要利用系統中有限的硬件資源實(shí)現高速、準確的二值圖像連通域標記，提出了一種適合FPGA實(shí)現的二值圖像連通域標記快速算法。算法以快捷、有效的方式識別、并記錄區域間復雜的連通關(guān)系。與傳統的二值圖像標記算法相比，該算法具有運算簡(jiǎn)單性、規則性和可擴展性的特點(diǎn)。利用FPGA實(shí)現該算法時(shí)，能夠準確有效的識別出圖像中復雜的連通關(guān)系，產(chǎn)生正確的標記結果。在100MHz工作時(shí)鐘下，處理384
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基于FPGA的高速可變周期脈沖發(fā)生器的設計
- 1 引 言 要求改變脈沖周期和輸出脈沖個(gè)數的脈沖輸出電路模塊在許多工業(yè)領(lǐng)域都有運用。采用數字器件設計周期和輸出個(gè)數可調節的脈沖發(fā)生模塊是方便可行的。為了使之具有高速、靈活的優(yōu)點(diǎn)，本文采用Atelra公司的可編程芯片FPGA設計了一款周期和輸出個(gè)數可變的脈沖發(fā)生器。經(jīng)過(guò)板級調試獲得良好的運行效果。 2 總體設計思路 脈沖的周期由高電平持續時(shí)間與低電平持續時(shí)間共同構成，為了改變周期，采用兩個(gè)計數器來(lái)分別控制高電平持續時(shí)間和低電平持續時(shí)間。計數器采用可并行加載初始值的N位減法計數器。設定：當要求的高電平
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基于FPGA的IDE硬盤(pán)接口卡的實(shí)現
- 引言 本文采用FPGA實(shí)現了IDE硬盤(pán)接口協(xié)議。系統提供兩套符合ATA-6規范的IDE接口，一個(gè)與普通IDE硬盤(pán)連接，另一個(gè)與計算機主板上的IDE接口相連。系統采用FPGA實(shí)現接口協(xié)議，完成接口數據的截獲、處理（在本文中主要是數據加密）和轉發(fā)，支持PIO和Ultra DMA兩種數據傳輸模式。下面重點(diǎn)介紹用FPGA實(shí)現接口協(xié)議的方法。 1 IDE接口協(xié)議簡(jiǎn)介 1.1 IDE接口引腳定義 IDE（Integrated Drive Electronics）即“電子集成驅動(dòng)器”，又稱(chēng)為ATA接口。表1列
- 關(guān)鍵字： FPGA IDE硬盤(pán) 單片機 嵌入式系統 存儲器
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