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基于FPGA的UPFC控制器IP設計

  • 　0 引言 　　統一潮流控制器(Unified Power Flow Con-troller，簡(jiǎn)稱(chēng)UPFC)是一種可以較大范圍地控制電流使之按指定路經(jīng)流動(dòng)的設備，它可在保證輸電線(xiàn)輸送容量接近熱穩定極限的同時(shí)又不至于過(guò)負荷?？刂葡到y是UPFC的核
  • 關(guān)鍵字： IP  設計  控制器  UPFC  FPGA  基于  

IP承載網(wǎng)絡(luò )規劃設計探討

  • 毋庸置疑，現代通信網(wǎng)絡(luò )的發(fā)展，是由業(yè)務(wù)需求和市場(chǎng)需求來(lái)決定的，而不是技術(shù)的發(fā)展。我們回頭看看互聯(lián)網(wǎng)（IP網(wǎng)絡(luò )）的發(fā)展歷程，這其中市場(chǎng)推動(dòng)的痕跡非常明顯：這一種六七十年代就已經(jīng)誕生的IP網(wǎng)絡(luò )技術(shù)，在九十年代
  • 關(guān)鍵字： 探討  規劃設計  網(wǎng)絡(luò )  承載  IP  

基于Nios II處理器的SVPWM IP Core設計

  • 摘要 為降低FPGA實(shí)現3電平SVPWM算法的復雜性，減小SVPWM模塊所占用的資源，文中利用正弦函數和余弦函數的關(guān)系，采用小容量ROM提出了一種新的SVPWM控制算法。利用Verilog HDL實(shí)現了算法的硬件設計，并封裝成IP核以方便
  • 關(guān)鍵字： SVPWM  Nios  Core  IP    

基于Nios II步進(jìn)電機控制器IP核的設計與實(shí)現

  • 摘要 根據Nios II處理器的Avalon總線(xiàn)規范，設計了一款面向步進(jìn)電機的控制器IP核。該定制IP核采用軟、硬件協(xié)同設計的方法，功能符合Avalon總線(xiàn)的讀寫(xiě)傳輸時(shí)序，具有完備的步進(jìn)電機驅動(dòng)能力。仿真結果表明，該IP核具有
  • 關(guān)鍵字： IP  設計  實(shí)現  控制器  電機  Nios  II  步進(jìn)  基于  

IP承載網(wǎng)絡(luò )規劃設計分析

  • 毋庸置疑，現代通信網(wǎng)絡(luò )的發(fā)展，是由業(yè)務(wù)需求和市場(chǎng)需求來(lái)決定的，而不是技術(shù)的發(fā)展。我們回頭看看互聯(lián)網(wǎng)（IP網(wǎng)絡(luò )）的發(fā)展歷程，這其中市場(chǎng)推動(dòng)的痕跡非常明顯：這一種六七十年代就已經(jīng)誕生的IP網(wǎng)絡(luò )技術(shù)，在九十年代
  • 關(guān)鍵字： 分析  規劃設計  網(wǎng)絡(luò )  承載  IP  

ATM網(wǎng)絡(luò )與IP兼容技術(shù)介紹

  • ATM可以提供空前的可伸縮性和性?xún)r(jià)比，以及對將來(lái)的實(shí)時(shí)業(yè)務(wù)、多媒體業(yè)務(wù)等的支持,ATM將扮演重要的角色。但目前的信息體系，即LAN和WAN，建立在網(wǎng)絡(luò )層協(xié)議如IP、IPX、AppleTalk等的基礎上，因此，ATM的成功及Internet
  • 關(guān)鍵字： 技術(shù)  介紹  兼容  IP  網(wǎng)絡(luò )  ATM  

基于IP復用和SOC技術(shù)的微處理器FSPLCSOC模塊設計

  • 基于IP復用和SOC技術(shù)的微處理器FSPLCSOC模塊設計,1 引言 　　文中采用IP核復用方法和SOC技術(shù)基于A(yíng)VR 8位微處理器AT90S1200IP Core設計專(zhuān)用PLC微處理器FSPLCSOC模塊。隨著(zhù)芯片集成程度的飛速提高，IC產(chǎn)業(yè)中形成了以片上系統SOC(System-on-Chip)技術(shù)為主的設計方式。一
  • 關(guān)鍵字： FSPLCSOC  模塊  設計  微處理器  技術(shù)  IP  復用  SOC  基于  

MCU&USB設備控制器IP核的設計

  • MCUUSB設備控制器IP核的設計,摘要：用硬件描述語(yǔ)言verilog HDL設計實(shí)現了一種MCUUSB設備控制器IP核。論文首先簡(jiǎn)要介紹了設計的背景,重點(diǎn)對自主研發(fā)的將MCUUSB控制器集成于一個(gè)芯片的設計和研究分析。最后給出nc-verilog功能仿真方案以及FPGA驗
  • 關(guān)鍵字： 設計  IP  控制器  設備  MCU&USB  

嵌入式微處理器IP core設計與分析

  • 嵌入式微處理器IP core設計與分析,摘要：本文在對傳統微控制器進(jìn)行系統分析的基礎上，提出了一種較好的改進(jìn)設計方法?；乇芰藗鹘y微控制器基于累加器的ALU結構及算術(shù)邏輯指令：并在指令執行時(shí)序上盡量減少指令執行所需的時(shí)鐘周期。通過(guò)仿真驗證證明該設
  • 關(guān)鍵字： 設計  分析  core  IP  微處理器  嵌入式  

基于嵌入式Linux的TFT LCD IP及驅動(dòng)的設計

  • 系統總體設計方案本系統的總體設計框圖如圖1所示。
    圖1 系統框圖

    Nios II處理器在SDRAM中開(kāi)辟幀緩沖(Frame buffer)，可以是單緩沖也可以是雙緩沖。以單緩沖為例。處理器將一幀圖像數據(640times;480times;2Byt
  • 關(guān)鍵字： IP  驅動(dòng)  設計  LCD  TFT  嵌入式  Linux  基于  

AVR AT90S1200 IP核設計及復用技術(shù)

  • 1 引言　　隨著(zhù)芯片集成程度的飛速提高，一個(gè)電子系統或分系統可以完全集成在一個(gè)芯片上，IC產(chǎn)業(yè)中形成了以片上系統SOC(System-on-Chip)技術(shù)為主的設計方式。同時(shí)IC設計能力和EDA工具卻相對落后于半導體工藝技術(shù)的發(fā)
  • 關(guān)鍵字： 復用  技術(shù)  設計  IP  AT90S1200  AVR  

移動(dòng)操作SoC接口IP組件設計

  • 移動(dòng)操作SoC接口IP組件設計,　1 引言

    　　移動(dòng)操作或移動(dòng)計算（mobile computing）原是通訊領(lǐng)域的研究方向，隨著(zhù)數字無(wú)線(xiàn)通信技術(shù)和嵌入式計算技術(shù)的發(fā)展、應用與融合，移動(dòng)操作已逐步成為嵌入式系統中很具發(fā)展潛力的一個(gè)領(lǐng)域［1］。SoC（Sy
  • 關(guān)鍵字： 組件  設計  IP  接口  操作  SoC  移動(dòng)  

基于IP軟電話(huà)設計的端到端視頻通信技術(shù)

  • 擁有軟電話(huà)視頻許可的用戶(hù)，只需要在桌面電腦上安裝Avaya的IP軟件電話(huà)，并且配置一個(gè)普通的USB攝像頭，即具備了端到端視頻通信功能。Avaya IP語(yǔ)音通信系統可為使用Avaya IP軟件電話(huà)的用戶(hù)提供端到端的視頻通信能力。
  • 關(guān)鍵字： 視頻  通信技術(shù)  設計  電話(huà)  IP  基于  

TCP/IP的浮標網(wǎng)絡(luò )通信系統設計策略

  • 水聲信道匹配基礎研究是建立在水聲學(xué)、海洋物理聲學(xué)以及現代信號處理技術(shù)基礎上的新興研究領(lǐng)域。為滿(mǎn)足研究需要而構建的局部海域水聲信道測量平臺（圖 1），能夠實(shí)現環(huán)境信息和信道參量的系統采集和實(shí)時(shí)傳遞，對信道
  • 關(guān)鍵字： 設計  策略  系統  網(wǎng)絡(luò )通信  浮標  TCP/IP  

基于IP核及可重構設計的信息安全SoC芯片的實(shí)現

  • 基于IP核及可重構設計的信息安全SoC芯片的實(shí)現,當前,信息安全防護已經(jīng)從傳統的單點(diǎn)信息加密發(fā)展到了以芯片級硬件防護為基礎,構建覆蓋全網(wǎng)絡(luò )系統的信息保障體系?；谛酒壍挠布鉀Q方案已經(jīng)成為保證信息安全的最可靠的途徑?？芍貥嬓畔踩玈oC芯片是基于信息安全
  • 關(guān)鍵字： SoC  芯片  實(shí)現  安全  信息  IP  重構  設計  基于  
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