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FPGA實(shí)戰開(kāi)發(fā)技巧（7）

  • FPGA實(shí)戰開(kāi)發(fā)技巧（7）-通常我們會(huì )為工程添加UCF 約束指定時(shí)序要求和管腳約束。但是UCF 約束是給MAP，PAR 等實(shí)現使用的，綜合工具XST 并不能感知系統的時(shí)序要求。而為XST 添加X(jué)CF 約束卻是使實(shí)現結果擁有最高頻率的關(guān)鍵。
  • 關(guān)鍵字： FPGA  XCF  UCF  
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