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硬件電路時(shí)序計算方法與應用實(shí)例
- 摘要：本文針對高速電路設計中經(jīng)常面臨的時(shí)序問(wèn)題，提出了時(shí)序分析和計算方法，并結合SPI4.2接口給出了具體分析實(shí)例。 1 滿(mǎn)足接收端芯片的建立/保持時(shí)間的必要性 在高速數字電路設計中，由于趨膚效應、臨近干擾、電流高速變化等因素，設計者不能單純地從數字電路的角度來(lái)審查自己的產(chǎn)品，而要把信號看作不穩定的模擬信號。采用頻譜分析儀對信號分析，可以發(fā)現，信號的高頻譜線(xiàn)主要來(lái)自于信號的變化沿而不是信號頻率。例如一個(gè)1MHz的信號，雖然時(shí)鐘周期為1微秒，但是如果其變化沿上升或下降時(shí)間為納秒級，則在頻譜儀
- 關(guān)鍵字： DATA 源同步系統 數據類(lèi)信號 時(shí)序 TSCLK 201412
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