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基于FPGA的嵌入式串行千兆以太網(wǎng)設計
- 本設計以Xilinx FPGA為棱心芯片，利用內嵌硬核處理器PowerPC、嵌入式操作系統Xilkernel和LwIP協(xié)議功能函數，完成嵌入式串行千兆以太網(wǎng)系統的設計。本設計能夠滿(mǎn)足以太網(wǎng)通信對高速數據傳輸的要求，同時(shí)在電路設計時(shí)，具有PCB布線(xiàn)簡(jiǎn)單以及信號完整性好等優(yōu)點(diǎn)。
- 關(guān)鍵字： 千兆以太網(wǎng) FPGA SGMII PowerPCA40
Altera Stratix III FPGA的LVDS I/O支持SGMII
- Altera公司今天宣布，Stratix® III FPGA在其LVDS I/O上支持串行千兆位介質(zhì)無(wú)關(guān)接口(SGMII)。Stratix III LVDS I/O的接口速率達到1.25 Gbps，滿(mǎn)足SGMII嚴格的抖動(dòng)性能要求，支持不含收發(fā)器的三速以太網(wǎng)(10/100/1000 Mbps)接口。Stratix III FPGA是業(yè)界首款在LVDS引腳上支持千兆以太網(wǎng)SGMII的可編程邏輯器件，降低了每個(gè)器件的成本和功耗，提供更多的接口。 Stratix III FPGA的SGMII
- 關(guān)鍵字： Altera Stratix III FPGA SGMII 以太網(wǎng)
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