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采用FPGA IP實(shí)現DDR的讀寫(xiě)控制的設計與驗證
- 摘要： 本文采用LatticeXP系列FPGA結合IP解決DDR RAM的讀寫(xiě)控制。并且在硬件上面進(jìn)行了實(shí)際測試。關(guān)鍵詞： 嵌入式系統；DDR RAM；FPGA；IP；LattcieXP 前言隨著(zhù)高速處理器的不斷發(fā)展，嵌入式系統應用的領(lǐng)域越來(lái)越廣泛，數字信號處理的規模也越來(lái)越大，系統中RAM規模不斷增加，比如視頻監控、圖像數據采集等領(lǐng)域，圖像處理的實(shí)時(shí)性對RAM帶寬的要求不斷增加，傳統的SDRAM在帶寬上已經(jīng)逐漸無(wú)法滿(mǎn)足應用要求，DDR SDRAM(雙倍速率SDRAM)采用在時(shí)鐘CL
- 關(guān)鍵字： 0702_A DDR FPGA IP LattcieXP RAM 單片機 嵌入式系統 雜志_設計天地 存儲器
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