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RF電路中LDO電源抑制比和噪聲的選擇

  • 摘要: 本文討論了LDO的特點(diǎn)以及RF電路對LDO的電源抑制比和噪聲的選擇。關(guān)鍵詞: 低壓差線(xiàn)性穩壓器;電源抑制比;噪聲 引言便攜產(chǎn)品電源設計需要系統級思維,在開(kāi)發(fā)由電池供電的設備時(shí),諸如手機、MP3、PDA、PMP、DSC等低功耗產(chǎn)品,如果電源系統設計不合理,將影響到整個(gè)系統的架構、產(chǎn)品的特性組合、元件的選擇、軟件的設計和功率分配。同樣,在系統設計中,也要從節省電池能量的角度出發(fā)多加考慮。帶有使能控制的低壓差線(xiàn)性穩壓器(LDO)是不錯的選擇。 射頻電路的電源要求大多數蜂窩電話(huà)基帶
  • 關(guān)鍵字: 0611_A  RF專(zhuān)題  電源技術(shù)  模擬技術(shù)  雜志_技術(shù)長(cháng)廊  模擬IC  電源  

FPGA協(xié)同處理的優(yōu)勢

  • 摘要: 本文介紹的ESL技術(shù)為傳統的DSP系統設計人員提供了有效的FPGA的設計實(shí)現方法。關(guān)鍵詞: DSP;FPGA;ESL 傳統的、基于通用DSP處理器并運行由C語(yǔ)言開(kāi)發(fā)的算法的高性能DSP平臺,正在朝著(zhù)使用FPGA預處理器和/或協(xié)處理器的方向發(fā)展。這一最新發(fā)展能夠為產(chǎn)品提供巨大的性能、功耗和成本優(yōu)勢。盡管優(yōu)勢如此明顯,但習慣于使用基于處理器的系統進(jìn)行設計的團隊,仍會(huì )避免使用FPGA,因為他們缺乏必要的硬件技能,來(lái)將FPGA用作協(xié)處理器(圖1)。不熟悉像VHDL和Verilog這樣
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FPGA進(jìn)入嵌入式領(lǐng)域,處理器內核成關(guān)鍵

  • 全球FPGA整體市場(chǎng)最近幾年迅速擴大,其中與嵌入式FPGA處理器相關(guān)的Design Win數量正在迅速增長(cháng),潛力巨大。就像打開(kāi)潘多拉的盒子,有了可以運行操作系統或實(shí)時(shí)操作系統的處理器內核,相信FPGA正在真正意義上大規模進(jìn)入嵌入式設計領(lǐng)域。 從Xilinx、Altera到Actel、Lattice,FPGA提供商都已經(jīng)有可在FPGA邏輯模塊旁實(shí)現的“硬”核,或者可以直接在FPGA結構中運行的“軟” 核處理器。硬核的好處是能夠提供更快的數據處理能力,所謂軟核需要FPGA廠(chǎng)商提供的PLD軟件進(jìn)行配置,然后固
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前景展望:HSPDA 對 3G 手機設計的意義

  • 3G WCDMA/UMTS剛開(kāi)始在全球范圍部署,熱衷于新技術(shù)的人士就對這曾經(jīng)一度熱門(mén)的新技術(shù)失去了熱情,轉而開(kāi)始關(guān)注高速下行分組接入 (HSPDA) 技術(shù)的美好未來(lái)了。技術(shù)行業(yè)似乎總是如此的風(fēng)云變幻。一旦我們確信部署某種技術(shù)是可行的,我們就會(huì )開(kāi)始尋求下一個(gè)重大的創(chuàng )新突破,HSDPA 正是如此。因此,在加入論戰之前,請允許我說(shuō)明一點(diǎn):?jiǎn)?wèn)題并非在于 HSDPA 是否會(huì )對 UMTS 取而代之,而是 HSDPA 是否會(huì )順應一般趨勢發(fā)展成為一種容易部署的技術(shù),并成為現有 3G UMTS 網(wǎng)絡(luò )的軟件增強版。HSDPA
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數碼相機的圖像處理通道

  • 現在的數碼機都是采用CCD(電荷耦合元件)或CMOS感光器件—這些感光器件都是將光信號轉化為電信號,但兩者的轉換方式不一樣。 圖1 CCD的結構在CCD器件中—有幾百萬(wàn)的感光像素(Pixel)組成的陣列覆蓋在傳感器的表面。曝光后,整個(gè)CCD像素陣列上累積的電荷通過(guò)一定的時(shí)序,列隊從CCD傳感器的一個(gè)端口讀出,并通過(guò)一個(gè)專(zhuān)用模數轉換芯片進(jìn)行A/D轉換。CMOS則直接對每個(gè)像素的曝光量進(jìn)行A/D轉換。然而,CMOS的缺點(diǎn)就是感光度比CCD低,容易出現雜訊,這主要是因為CMOS的每一像素的結構要比CCD復
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與MSP430 USI端口配合使用ADS8361

  • 引言ADS8361 是一款采樣速率為 500kSPS 的 16 位雙路模數轉換器 (ADC),該轉換器具有 4 個(gè)全差分輸入通道,兩兩一對,以實(shí)現同步高速信號采集。采樣保持放大器的輸入端是全差分的,此外, ADC 的輸入端也保持為全差分。這使該 ADC 具有卓越的共模抑制能力:在 50kHz 時(shí)為 80dB,這在高噪聲環(huán)境下非常重要。新型 MSP430F2013 等 MSP430 器件具有通用串行接口(USI),因而可用于非常簡(jiǎn)單直接的接口,該接口不需要“粘接邏輯”且需要的軟件開(kāi)銷(xiāo)也很少。有的應用要求對同
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