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脈沖延遲
脈沖延遲 文章 進(jìn)入脈沖延遲技術(shù)社區
FPGA的多路可控脈沖延遲系統
- 摘要 采用數字方法和模擬方法設計了一種最大分辨率為0.15 ns級的多路脈沖延遲系統，可以實(shí)現對連續脈沖信號的高分辨率可控延遲；采用Flash FPGA克服了現有SRAM FPGA系統掉電后程序丟失的缺點(diǎn)，提高了系統反應速度。本系統適用于需要將輸入脈沖信號進(jìn)行精確延遲來(lái)產(chǎn)生測試或控制用的連續脈沖信號場(chǎng)合，具有很強的適用性。 關(guān)鍵詞 數字方法 模擬方法 分辨率 脈沖延遲 ProASIC3 在科學(xué)研究、通信和一些自動(dòng)控制中，經(jīng)常需要精確定時(shí)的
- 關(guān)鍵字： FPGA 數字方法 模擬方法 分辨率 脈沖延遲 ProASIC3
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脈沖延遲介紹
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脈沖延遲電路
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