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EEPW首頁(yè) >> 主題列表 >> 現場(chǎng)可編程門(mén)陣列(fpga)

現場(chǎng)可編程門(mén)陣列(fpga) 文章 進(jìn)入現場(chǎng)可編程門(mén)陣列(fpga)技術(shù)社區

滿(mǎn)足28nm迫切的低功耗需求

  • Altera低功耗28-nm器件的優(yōu)點(diǎn)包括,降低產(chǎn)品成本,降低或者放寬功耗預算,較低的散熱要求,能夠滿(mǎn)足更多的市場(chǎng)需求,在同樣的散熱和功耗預算內進(jìn)一步提高性能等。采用最全面的方法降低28-nm產(chǎn)品的功耗,Altera幫助設計人員滿(mǎn)足了迫切的低功耗需求。
  • 關(guān)鍵字: Altera  28nm  FPGA  

基于FPGA的音樂(lè )流水燈控制系統

  • 通過(guò) FPGA實(shí)現音樂(lè )流水燈的控制, 實(shí)質(zhì)上就是將不同音階與特定頻率的方波信號對應起來(lái), 以方波信號驅動(dòng)蜂鳴器發(fā)出音樂(lè ), 再根據不同音階來(lái)控制流水燈的閃爍。與借助微處理器實(shí)現樂(lè )曲演奏相比, 以純硬件方式完成樂(lè )曲演奏電路更直觀(guān)。EDA工具和硬件描述語(yǔ)言發(fā)揮了強大功能,提供了設計可能性。
  • 關(guān)鍵字: ALU  音樂(lè )流水燈  FPGA  

基于改進(jìn)的布斯算法的嵌入FPGA的乘法器設計

  • 設計了一款嵌入FPGA的乘法器,該乘法器能夠滿(mǎn)足兩個(gè)18 b有符號或17 b無(wú)符號數的乘法運算。該設計基于改進(jìn)的布斯算法,提出了一種新的布斯譯碼和部分積結構,并對9-2壓縮樹(shù)和超前進(jìn)位加法器進(jìn)行了優(yōu)化。該乘法器采用TSMC 0.18μn CMOS工藝,其關(guān)鍵路徑延遲為3.46 ns。
  • 關(guān)鍵字: 布斯算法  18×18乘法器  FPGA  

基于軟件無(wú)線(xiàn)電的數字偵聽(tīng)接收機研究

  • 為實(shí)現頻譜監測、通信偵察等任務(wù),提出了一種基于軟件無(wú)線(xiàn)電的數字偵察接收機的軟、硬件體系結構。該接收機基于高速數字信號處理器、大規?,F場(chǎng)可編程門(mén)陣列、高速AD芯片、高精度大動(dòng)態(tài)范圍AGC電路,實(shí)現了信號的寬頻段、寬帶接收;采用盲信號處理技術(shù),實(shí)現了對未知信號的參數辨識、分類(lèi)、盲解調。
  • 關(guān)鍵字: 頻譜監測  軟件無(wú)線(xiàn)電  FPGA  

基于A(yíng)TE的FPGA測試

  • 隨著(zhù)集成電路技術(shù)的飛速發(fā)展,FPGA的應用越來(lái)越廣泛,其測試技術(shù)也得到了廣泛重視和研究。文章簡(jiǎn)要介紹了FPGA的發(fā)展及其主要組成部分,提出了一種用ATE對FPGA進(jìn)行測試的方法和具體測試流程。
  • 關(guān)鍵字: AutomaticTestEquipment  配置數據  FPGA  

基于FPGA的多軟核圖像處理系統設計

  • 介紹以圖像處理為應用背景、基于FPGA芯片建立的多軟核系統設計。系統中包含兩個(gè)Nios II軟核處理器和兩個(gè)用于進(jìn)行圖像顏色空間轉換的CSC MegaCore IP核。兩個(gè)Nios II軟核處理器共享程序存儲器、數據存儲器及啟動(dòng)存儲器。在硬件設計方面,CSC MegaCore IP作為外圍組件通過(guò)一個(gè)自定義的接口控制器連接到以Nios II軟核處理器為核心的SoPC系統中。在軟件設計方面,運行在每個(gè)Nios II軟核處理器上的程序通過(guò)硬件Mutex核協(xié)調對共享數據存儲器的訪(fǎng)問(wèn)。
  • 關(guān)鍵字: 圖像處理  多軟核系統  FPGA  

基于FPGA的DDS IP核設計及仿真

  • 以Altera公司的QuartusⅡ7.2作為開(kāi)發(fā)工具,研究了基于FPGA的DDS IP核設計,并給出基于Signal TapⅡ嵌入式邏輯分析儀的仿真測試結果。將設計的DDS IP核封裝成為SOPC Builder自定義的組件,結合32位嵌入式CPU軟核NiosII,構成可編程片上系統(SOPC),利用極少的硬件資源實(shí)現了可重構信號源。該系統基本功能都在FPGA芯片內完成,利用SOPC技術(shù),在一片FPGA芯片上實(shí)現了整個(gè)信號源的硬件開(kāi)發(fā)平臺,達到既簡(jiǎn)化電路設計、又提高系統穩定性和可靠性的目的。
  • 關(guān)鍵字: 直接數字頻率合成  IP核  FPGA  

基于FPGA的遺傳算法組合邏輯電路設計

  • 基于遺傳算法的組合邏輯電路的自動(dòng)設計,依據給出的真值表,利用遺傳算法自動(dòng)生成符合要求的組合邏輯電路。由于遺傳算法本身固有的并行性,采用軟件實(shí)現的方法在速度上往往受到本質(zhì)是串行計算的計算機制約,因此采用硬件化設計具有重要的意義。為了證明基于FPGA的遺傳算法的高效性,設計了遺傳算法的各個(gè)模塊,實(shí)現了基于FPGA的遺傳算法。
  • 關(guān)鍵字: 遺傳算法  自然進(jìn)化  FPGA  

FPGA設計安全性綜述

  • 現場(chǎng)可編程門(mén)陣列(Field Programmable Gate Array,FPGA)在通信、圖形、控制、計算等領(lǐng)域的廣泛應用,已經(jīng)成為當今電子系統中的重要組成部分.隨著(zhù)越來(lái)越多的系統采用FPGA實(shí)現核心設計,使得FPGA中的設計和知識產(chǎn)權變得更加重要,建立FPGA代碼運行安全體系已成為大型產(chǎn)品設計中重要的考慮因素.本文闡述了FPGA的多種安全解決方案,并探討分析了FPGA的設計安全性.
  • 關(guān)鍵字: 代碼運行安全  安全解決方案  FPGA  

基于FPGA的半導體激光器自動(dòng)功率控制系統設計

  • 半導體激光器的自動(dòng)功率控制是解決激光器閾值漂移的重要手段,本文設計了一個(gè)基于FPGA的數字激光自動(dòng)功率控制系統,該控制系統主要由光電檢測、A/D轉換、SOC控制、APC判定、PWM反饋輸出及低通濾波幾個(gè)部分組成。該自動(dòng)功率控制系統使用硬件資源少,根據不同的設計要求,通過(guò)增加PWM模塊和簡(jiǎn)單的模擬器件或者改變控制寄存器的設置,就可以實(shí)現多級激光功率和多個(gè)激光器的控制,可以大大縮短設計周期。
  • 關(guān)鍵字: 數字激光器  自動(dòng)功率控制  FPGA  

反射式全景視頻實(shí)時(shí)平面顯示技術(shù)的FPGA實(shí)現

  • 介紹了反射式全景圖像展開(kāi)原理,分析了圖像產(chǎn)生鋸齒失真和階梯化現象的原因,提出了解決問(wèn)題的算法,并設計了FPGA實(shí)現的系統硬件結構。
  • 關(guān)鍵字: 全景圖像  鋸齒失真  FPGA  

基于FPGA的數字顯示系統設計

  • 本文以Virtex-II系列PlatformFPGA為例,說(shuō)明采用FPGA方案進(jìn)行數字顯示系統設計所具有的靈活、快速和低成本等特性。
  • 關(guān)鍵字: 數字顯示系統  SoC  FPGA  

一種基于偏振原理和FPGA的調光系統設計

  • 設計了一種光強自動(dòng)調節系統。通過(guò)光電傳感電路實(shí)現光電信號的轉換,使用FPGA對數據進(jìn)行實(shí)時(shí)處理,并以實(shí)驗環(huán)境光照強度測試結果為參照對所測光強進(jìn)行線(xiàn)性變換修正,進(jìn)而查表獲得舵機偏轉角度的控制量,通過(guò)改變偏振片偏振化方向夾角來(lái)調節入射光強。自動(dòng)調光系統測量精度較高,實(shí)時(shí)調節性較好,魯棒性較強。
  • 關(guān)鍵字: 光強調節  光電傳感  FPGA  

基于FPGA實(shí)現視頻圖像的一種運動(dòng)估計設計

  • 利用功能強大的FPGA實(shí)現視頻圖像的一種運動(dòng)估計設計,采用的搜索方法是三步搜索法。在進(jìn)行方案設計時(shí),本文采用了技術(shù)比較成熟的VHDL語(yǔ)言進(jìn)行設計,并使用Quartus II軟件進(jìn)行時(shí)序仿真。由仿真結果可知,無(wú)論是在功能的實(shí)現上還是在搜索的準確性、高效性以及FPGA片上資源的利用率上,本設計方案都具有明顯的優(yōu)越性。
  • 關(guān)鍵字: 運動(dòng)估計  視頻編碼器  FPGA  

同步數字復接的設計及其FPGA技術(shù)實(shí)現

  • 在簡(jiǎn)要介紹同步數字復接基本原理的基礎上,采用VHDL語(yǔ)言對同步數字復接各組成模塊進(jìn)行了設計,并在ISE集成環(huán)境下進(jìn)行了設計描述、綜合、布局布線(xiàn)及時(shí)序仿真,取得了正確的設計結果,同時(shí)利用中小容量的FPGA實(shí)現了同步數字復接功能。
  • 關(guān)鍵字: 同步數字復接  VHDL  FPGA  
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現場(chǎng)可編程門(mén)陣列(fpga)介紹

您好,目前還沒(méi)有人創(chuàng )建詞條現場(chǎng)可編程門(mén)陣列(fpga)!
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