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EEPW首頁(yè) >> 主題列表 >> 抽取濾波器

基于XC2V1000型FPGA的FIR抽取濾波器的設計

  • 　　1 引言 　　抽取濾波器廣泛應用在數字接收領(lǐng)域,是數字下變頻器的核心部分。目前,抽取濾波器的實(shí)現方法有3種：?jiǎn)纹ㄓ脭底譃V波器集成電路、DSP和可編程邏輯器件。使用單片通用數字濾波器很方便,但字長(cháng)和階數的規格較少,不能完全滿(mǎn)足實(shí)際需要。使用DSP雖然簡(jiǎn)單,但程序要順序執行,執行速度必然慢?，F場(chǎng)可編程門(mén)陣列(FPGA)有著(zhù)規整的內部邏輯陣列和豐富的連線(xiàn)資源,特別適用于數字信號處理,但長(cháng)期以來(lái),用FPGA實(shí)現抽取濾波器比較復雜,其原因主要是FPGA中缺乏實(shí)現乘法運算的有效結構?，F在,FPGA集成了乘法器
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基于FPGA的高階FIR抽取濾波器有效實(shí)現結構

  • 摘要 針對高階FIR抽取濾波器直接型結構和多相濾波結構中存在乘法器資源使用較多，導致實(shí)際系統實(shí)現困難的問(wèn)題，提出了一種適合FPGA實(shí)現的高效多相結構。該結構采用分時(shí)復用技術(shù)，通過(guò)提高FPGA工作時(shí)鐘頻率，對降采樣
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改進(jìn)型CIC抽取濾波器設計與FPGA實(shí)現

  • 摘 要：為了改善級聯(lián)積分梳狀(CIC)濾波器通帶不平和阻帶衰減不足的缺點(diǎn)，給出一種改進(jìn)型CIC濾波器。該濾波器在采用 COSINE濾波器提高阻帶特性的基礎上，級聯(lián)了一個(gè)SINE濾波器，補償了其通帶衰減。硬件實(shí)現時(shí)，采用新
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FPGA實(shí)現FIR抽取濾波器的設計

  • 摘要：采用基于分布式算法思想的方法來(lái)設計FIR濾波器，利用FDAt001設計系統參數，計算濾波器系數，同時(shí)為了要滿(mǎn)足系統要求考慮系數的位數。根據FIR數字濾波器結構，對FIR數字濾波器的FPGA實(shí)現方法進(jìn)行分析。
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抽取濾波器介紹

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