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EEPW首頁(yè) >> 主題列表 >> 可編程邏輯器件

一種基于CPLD的DMA控制器IP核設計

  • 但是由于8013硬件結構和指令系統的限制,當需要高速率大批量數據傳送時(shí),數據吞吐速率往往不能滿(mǎn)足設計要求。即使采用提升振蕩器頻率的辦法,結果仍不
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新手福音:概述學(xué)習FPGA的一些常見(jiàn)誤區

  • 新手福音:概述學(xué)習FPGA的一些常見(jiàn)誤區-很多剛開(kāi)始學(xué)習FPGA的朋友們經(jīng)常會(huì )遇上一些誤區而無(wú)從解決,FPGA為什么是可以編程的?通過(guò)HDL語(yǔ)言怎么看都看不出硬件結構?...本文就這個(gè)方面進(jìn)行解析。
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可編程邏輯器件設計技巧

CPLD/FPGA技術(shù)及電子設計自動(dòng)化

  • 電子設計自動(dòng)化(EDA)的實(shí)現是與CPLD/FPGA技術(shù)的迅速發(fā)展息息相關(guān)的。CPLD/FPGA是80年代中后期出現的,其特點(diǎn)是具有用戶(hù)可編程的特性。利用PLD/FPGA,電子系統設計工程師可以在實(shí)驗室中設計出專(zhuān)用IC,實(shí)現系統的集成,從而大大縮短了產(chǎn)品開(kāi)發(fā)、上市的時(shí)間,降低了開(kāi)發(fā)成本。此外,CPLD/FPGA還具有靜態(tài)可重復編程或在線(xiàn)動(dòng)態(tài)重構特性,使硬件的功能可象軟件一樣通過(guò)編程來(lái)修改,不僅使設計修改和產(chǎn)品升級變得十分方便,而且極大地提高了電子系統的靈活性和通用能力。
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FPGA管腳分配需要考慮的因素

  • 在芯片的研發(fā)環(huán)節,FPGA 驗證是其中的重要的組成部分,如何有效的利用 FPGA 的資源,管腳分配也是必須考慮的一個(gè)重要問(wèn)題。一般較好的方法是在綜合過(guò)程中通過(guò)時(shí)序的一些約束讓對應的工具自動(dòng)分配,但是從研發(fā)的時(shí)間段上來(lái)考慮這種方法往往是不可取的,RTL驗證與驗證板設計必須是同步進(jìn)行的,在驗證代碼出來(lái)時(shí)驗證的單板也必須設計完畢,也就是管腳的分配也必須在設計代碼出來(lái)之前完成。
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mcu,DSP,PLD/EDA的介紹/比較/分析

選用FPGA和完整的IP解決方案優(yōu)化汽車(chē)電氣架構設計

  • 車(chē)載網(wǎng)絡(luò )協(xié)議的數量有所減少,但實(shí)際部署的網(wǎng)絡(luò )數量卻有顯著(zhù)增加。這就提出了網(wǎng)絡(luò )架構的可縮放性問(wèn)題,并且要求為滿(mǎn)足各種應用和網(wǎng)絡(luò )的實(shí)際需要而優(yōu)化半導體器件。
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可編程邏輯器件與單片機在雙控制器中的設計

  • 可編程邏輯器件的D觸發(fā)器資源非常有限,而且可編程邏輯器件在控制時(shí)序方面不如單片機那樣方便,很多不熟悉的應用者往往感到應用起來(lái)非常的困難。利用可編程邏輯器件和單片機構成的雙向通信控制器克服了兩者的缺點(diǎn),且把二者的長(cháng)處最大限度地發(fā)揮出來(lái)。
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醫療設備對可編程邏輯器件的要求

  •   我們可以看到醫療設備行業(yè)中在幫助加強醫療設施和改善病人護理方面的一些趨勢。 包括:  · 小型化 - 小型化旨在實(shí)現低功耗、移動(dòng)化、便攜式、創(chuàng )傷性更小以及集成度更高的醫療和健康監測設備;  · 便攜式 - 電池供電,使用可穿戴設備進(jìn)行檢測(例如血糖監測);  · 無(wú)線(xiàn)互連 - 使用電池和無(wú)線(xiàn)視頻傳輸功能取代系繩和電纜,提高移動(dòng)性、可擴展性和放置的靈活性;  · 高性?xún)r(jià)比的解決方案 -
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三柵極技術(shù)給FPGA帶來(lái)突破性?xún)?yōu)勢

  • 本文考察了半導體制造業(yè)中晶體管設計從傳統平面向3D結構轉化的影響,以及其對可編程邏輯器件性能的顯著(zhù)提升。引言2013年2月,Altera公司與Intel公司共同宣布了Altera下一代最高性能FPGA產(chǎn)品的生產(chǎn)將獨家采用Intel的
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基于可編程邏輯器件的數字電路設計

  •   0 引 言   可編程邏輯器件PLD(Programmable Logic De-vice)是一種數字電路,它可以由用戶(hù)來(lái)進(jìn)行編程和進(jìn)行配置,利用它可以解決不同的邏輯設計問(wèn)題。PLD由基本邏輯門(mén)電路、觸發(fā)器以及內部連接電路構成,利用軟件和硬件(編程器)可以對其進(jìn)行編程,從而實(shí)現特定的邏輯功能??删幊踢壿嬈骷?0世紀70年代初期以來(lái)經(jīng)歷了從 PROM,PLA,PAL,GAL到CPLD和FPGA的發(fā)展過(guò)程,在結構、工藝、集成度、功能、速度和靈活性方面都有很大的改進(jìn)和提高。   隨著(zhù)數字集成電路的不斷
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一種基于CPLD的可編程FV變換電路

  • 摘要:文章介紹了一種可編程的頻率電壓變換電路(F/V),將頻率信號通過(guò)復雜可編程邏輯器件(CPLD)變換為與頻率成正比的脈寬信號,脈寬信號控制模擬開(kāi)關(guān)對基準電壓信號進(jìn)行斬波,斬波信號經(jīng)低通濾波后輸出直流電壓信號
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一種新型的交流電源信號發(fā)生器的設計

  • 摘要:介紹了交流電源信號發(fā)生器的基本原理,闡述了國內外有關(guān)交流電源信號發(fā)生器設計的基本方法,基于可編程邏輯器件(CPLD)設計實(shí)現了交流電源信號發(fā)生器,并給出了仿真及實(shí)驗波形。
    關(guān)鍵詞:可編程邏輯器件;交流
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可編程邏輯器件的應用參考

  • 引言隨著(zhù)大規模超大規??删幊踢壿嬈骷陌l(fā)展,邏輯器件日益以其低廉的價(jià)格及靈活的設計方式、豐富完備的功能而廣泛應用于電子線(xiàn)路設計中。采用CPLD可對邏輯電路功能進(jìn)行綜合集成,根據需要設計最小的單元,節約系統
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可編程邏輯器件接地設計

  • 信號接地處理和地線(xiàn)設計也是高速FPGA設計的一部分,設計一個(gè)好的接地系統非常重要。接地的方法可以歸納為3種,即單點(diǎn)接地、多點(diǎn)接地和復合式接地。接地的類(lèi)型分為模擬地和數字地等。(1)單點(diǎn)接地單點(diǎn)接地是指在電路設
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可編程邏輯器件介紹

  為專(zhuān)門(mén)目的而設計的電路稱(chēng)為專(zhuān)用集成電路(ASIC),專(zhuān)用集成電路減小了電路的體積、重量、功耗,而且大大提高了電路的穩定性。然而在用量不大的情況下,設計和制造這樣的專(zhuān)用集成電路不僅成本很高,而且設計制造的周期也太長(cháng)??删幊踢壿嬈骷难兄茷榻鉀Q這個(gè)矛盾提供了一條比較理想的途徑。   可編程邏輯器件(programmable logic device)即PLD。   PLD是做為一種通用集成電路而產(chǎn) [ 查看詳細 ]

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