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功耗優(yōu)化
功耗優(yōu)化 文章 進(jìn)入功耗優(yōu)化技術(shù)社區
基于A(yíng)SIC的功耗評估與優(yōu)化設計
- Power estimation and optimization based on ASIC design尹遠，黃嵩人（湘潭大學(xué)物理與光電工程學(xué)院，湖南 湘潭 411105）?????? 摘要：隨著(zhù)芯片設計的復雜度和規模越來(lái)越大，現如今ASIC芯片的功耗要求也越來(lái)越高。低功耗設計作為一個(gè)重要目標，需要設計者格外重視[1] 。在本文中，首先討論了功耗的組成及來(lái)源，闡述了在設計初期的功耗評估，以及功耗優(yōu)化的思路[1] 。接著(zhù)描述了功耗優(yōu)化的具體操作
- 關(guān)鍵字： 低功耗設計 功耗評估 功耗優(yōu)化 時(shí)鐘門(mén)控 201904
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功耗優(yōu)化介紹
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