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位同步時(shí)鐘
位同步時(shí)鐘 文章 進(jìn)入位同步時(shí)鐘技術(shù)社區
基于FPGA的提取位同步時(shí)鐘DPLL設計
- 在數字通信系統中，同步技術(shù)是非常重要的，而位同步是最基本的同步。位同步時(shí)鐘信號不僅用于監測輸入碼元信號，確保收發(fā)同步，而且在獲取幀同步及對接收的數字碼元進(jìn)行各種處理的過(guò)程中也為系統提供了一個(gè)基準
- 關(guān)鍵字： FPGA DPLL 位同步時(shí)鐘
一種快速位同步時(shí)鐘提取方案及實(shí)現
- 本文比較了兩種常用位同步提取電路的優(yōu)缺點(diǎn)，在此基礎上提出了一種基于CPLD/FPGA、用于數字通信系統的新型快速位同步方案。此方案借助Altera的設計工具設計了位同步提取電路，并利用FPGA予以實(shí)現，同時(shí)給出了該電路的仿真試驗波形圖。
- 關(guān)鍵字： 位同步時(shí)鐘 方案
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位同步時(shí)鐘介紹
您好，目前還沒(méi)有人創(chuàng )建詞條位同步時(shí)鐘!
歡迎您創(chuàng )建該詞條，闡述對位同步時(shí)鐘的理解，并與今后在此搜索位同步時(shí)鐘的朋友們分享。 創(chuàng )建詞條
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