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EEPW首頁(yè) > EDA/PCB > 設計應用 > FPGA和ARM的Profibus-DP主站通信平臺設計

FPGA和ARM的Profibus-DP主站通信平臺設計

作者: 時(shí)間:2010-04-01 來(lái)源:網(wǎng)絡(luò ) 收藏

3 系統工作過(guò)程
系統工作過(guò)程主要是控制器和交互過(guò)程,如圖5所示。從系統安全性上考慮,建立必須有雙方的確認信號,雖然Altera Cyclone系列FP-GA從上電到穩定之前引腳沒(méi)有輸出,從系統安全性角度考慮還是不夠的。


這里_READY信號的設計是考慮到FPGA內部鎖相環(huán)模塊PLL穩定工作之前需要建立時(shí)間,而其未穩定時(shí)是不能對其進(jìn)行操作的。的狀態(tài)通過(guò)控制器上的狀態(tài)機(FDL控制狀態(tài)機、調度狀態(tài)機和主從通信狀態(tài)機)進(jìn)行轉換,根據定時(shí)要求、從站響應幀給出的信息,以及錯誤檢查等信息,狀態(tài)機能夠應付一般的異常并自行恢復到正常的通信之中。

4 結論
協(xié)議用任何微處理器都能實(shí)現,只要微處理器配有內部或外部的異步串行接口(UART),但當數據傳輸速率較快(超過(guò)500 kb/s)時(shí),用ASIC芯片來(lái)實(shí)現更安全可靠。本文充分利用了FPGA實(shí)時(shí)性好和ARM核微控制器便于開(kāi)發(fā)的優(yōu)點(diǎn),實(shí)現了 1類(lèi)主站,經(jīng)過(guò)搭建簡(jiǎn)單測試環(huán)境進(jìn)行測試,能和市場(chǎng)上的成品主從站建立通信連接并進(jìn)行基本的主主、主從通信。


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