加減法運算電路的設計方法
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式(5)反映了輸入信號比例系數與附加電阻、平衡電阻、反饋電阻的關(guān)系，表明在滿(mǎn)足電阻平衡的條件下，各加運算輸入信號比例系數之和與各減運算輸入信號比例系數之和的差值可以大于l、小于1或等于1，即輸入信號的比例系數無(wú)限定。
根據輸入信號比例系數的數值范圍，加減運算電路還可簡(jiǎn)化。
2 比例系數加減結果特定取值時(shí)的電路簡(jiǎn)化方案
2．1 各加運算輸入信號比例系數之和與各減運算輸入信號比例系數之和的差值大于1的加減運算電路
當各輸入信號的比例系數關(guān)系為本文引用地址：http://dyxdggzs.com/article/187655.htm
時(shí)，可令式(5)中電阻Rp→∞，即圖1所示電路中去掉電阻Rp，由式(5)
中實(shí)現大于1的平衡條件。
2．2 各加運算輸入信號比例系數之和與各減運算輸入信號比例系數之和的差值小于1的加減運算電路
當各輸入信號的比例系數關(guān)系為
時(shí)，可令式(5)中電阻R’→∞，即圖1所示電路中去掉電阻R’，由式(5)中
實(shí)現小于1的平衡條件。
2．3 各加運算輸入信號比例系數之和與各減運算輸入信號比例系數之和的差值等于1的加減運算電路
當各輸入信號的比例系數關(guān)系為
時(shí)，可令式(5)中電阻R’→∞，Rp→∞，即圖1所示電路中去掉電阻R’及Rp。
3 設計步驟及舉例
3．1 設計步驟
(1)由參與運算的各輸入信號比例系數加、減的數值范圍確定電路形式；
(2)由運算關(guān)系及平衡條件確定外部各個(gè)電阻值。
3．2 設計舉例
例1，試設計實(shí)現u0=2u121+3u122-u111運算關(guān)系的加減運算電路。
將所要實(shí)現的運算關(guān)系式與式(4)對比，確定式(4)中各輸入信號的比例系數為
因，確定所設計電路的形式為圖1中去掉電阻Rp，按三個(gè)輸入信號重畫(huà)如圖2所示。
選取Rp=120kΩ，代入各輸入信號的比例系數表達式中，解出
R21=60kΩ，R22=40kΩ，R11=120kΩ
由式(5)并考慮Rp→∞，有
代入各輸入信號的比例系數，有
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