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Altera器件時(shí)間匹配問(wèn)題的解決方案

作者： 時(shí)間：2010-12-10 來(lái)源：網(wǎng)絡(luò ) 收藏

對于三到八譯碼器而言，用a、b、c表示輸入引腳，d0、d1、d2、d3、d4、d5、d6、d7 表示三到八譯碼器的輸出引腳。對該設計項目進(jìn)行編譯后模擬仿真，這時(shí)非常容易從模擬仿真出來(lái)的波形上看到出現了毛刺。如采用同步時(shí)鐘（引腳驅動(dòng)）方式，就可以消除毛刺。要注意的一點(diǎn)是建立和保持時(shí)間（Setup/hold time ）是測試芯片對輸入信號和時(shí)鐘信號之間的時(shí)間要求。建立時(shí)間是指觸發(fā)器的時(shí)鐘信號上升沿到來(lái)以前，數據穩定不變的時(shí)間。輸入信號應提前時(shí)鐘上升沿（如上升沿有效）T時(shí)間到達芯片，這個(gè)T就是建立時(shí)間Set up time。如不滿(mǎn)足Setup time，這個(gè)數據就不能被這一時(shí)鐘打入觸發(fā)器，只有在下一個(gè)時(shí)鐘上升沿，數據才能被打入觸發(fā)器。保持時(shí)間是指觸發(fā)器的時(shí)鐘信號上升沿到來(lái)以后，數據穩定不變的時(shí)間。hold time不夠，數據同樣不能被打入觸發(fā)器。我們選用a端的輸入脈沖寬度是時(shí)鐘脈沖的四倍，這樣D 觸發(fā)器就可以正常動(dòng)作，輸出結果是正確的，見(jiàn)圖3、圖4。如果我們一定要使輸入脈沖等于輸出脈沖的寬度，就要使輸入脈沖的高電平與時(shí)鐘脈沖的高電平錯開(kāi)，保證D觸發(fā)器能工作。

本文引用地址：http://dyxdggzs.com/article/151258.htm

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