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fpga是什么？fpga經(jīng)典設計與應用：基于FPGA的高速AD轉換系統
- fpga是什么？fpga經(jīng)典設計與應用：基于FPGA的高速AD轉換系統-在雷達設計中，需要對接收到的信號首先進(jìn)行模數轉換，其轉換速度和準確性直接決定了之后FFT等運算的準確性，最終影響雷達測量精度。介紹了一種基于FPGA，利用芯片ADS7890實(shí)現一種快速14位串行AD轉換，對系統的軟件和硬件做了說(shuō)明。硬件部分主要為ADS7890的基本外圍電路以及芯片EP2C35F672C與其的控制連接，軟件部分利用Quartus II 8．0編程。
- 關(guān)鍵字： fpga
時(shí)序分析中的一些基本概念
- 時(shí)序分析中的一些基本概念-時(shí)序分析時(shí)FPGA設計中永恒的話(huà)題，也是FPGA開(kāi)發(fā)人員設計進(jìn)階的必由之路。慢慢來(lái)，先介紹時(shí)序分析中的一些基本概念。
- 關(guān)鍵字： FPGA 時(shí)序分析 周期抖動(dòng)
數字時(shí)鐘管理模塊與嵌入式塊RAM
- 數字時(shí)鐘管理模塊與嵌入式塊RAM-業(yè)內大多數FPGA 均提供數字時(shí)鐘管理( 賽靈思公司的全部FPGA 均具有這種特性)。賽靈思公司推出最先進(jìn)的FPGA 提供數字時(shí)鐘管理和相位環(huán)路鎖定。相位環(huán)路鎖定能夠提供精確的時(shí)鐘綜合，且能夠降低抖動(dòng)，并實(shí)現過(guò)濾功能。
- 關(guān)鍵字： 數字時(shí)鐘管理 FPGA 賽靈思
Verilog HDL簡(jiǎn)明教程(part1)
- Verilog HDL簡(jiǎn)明教程(part1)-Verilog HDL是一種硬件描述語(yǔ)言，用于從算法級、門(mén)級到開(kāi)關(guān)級的多種抽象設計層次的數字系統建模。被建模的數字系統對象的復雜性可以介于簡(jiǎn)單的門(mén)和完整的電子數字系統之間。數字系統能夠按層次描述，并可在相同描述中顯式地進(jìn)行時(shí)序建模。
- 關(guān)鍵字： VerilogHDL FPGA
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