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譜線(xiàn)
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基于FPGA的自適應譜線(xiàn)增強系統設計
- 在此基于A(yíng)ltera公司的現場(chǎng)可編程門(mén)陣列(FPGA)芯片EP2C8F256C6,采用最小均方算法設計了自適應譜線(xiàn)增強(ALE)處理系統。以FPGA為處理核心,實(shí)現數據采樣控制、數據延時(shí)控制、LMS核心算法和輸出存儲控制等。充分利用FPGA高速的數據處理能力和豐富的片內乘法器,設計了LMS算法的流水線(xiàn)結構,保證整個(gè)系統具有高的數據吞吐能力和處理速度。并且通過(guò)編寫(xiě)相應的VHDL程序在QuartusⅡ軟件上進(jìn)行仿真,仿真結果表明該設計可以快速、準確地實(shí)現自適應譜線(xiàn)增強。
- 關(guān)鍵字： FPGA 譜線(xiàn) 系統設計
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譜線(xiàn)介紹
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