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編碼 文章 進(jìn)入編碼技術(shù)社區
多點(diǎn)協(xié)作系統中異步干擾特性及其預編碼設計
- 針對分布在不同地理位置的多基站協(xié)作下行系統，給出了信號傳輸的數學(xué)分析模型。在此基礎上，重點(diǎn)討論了在實(shí)際的多小區多用戶(hù)應用場(chǎng)景中，來(lái)自其他小區用戶(hù)對目標用戶(hù)的異步干擾信號特性，并提出了一種考慮信號異步傳輸特性的預編碼聯(lián)合優(yōu)化設計準則。性能分析表明，較理想同步情況下，在考慮多用戶(hù)信號傳輸異步特性時(shí)，系統性能將明顯下降，但若能在基站發(fā)射端通過(guò)聯(lián)合預編碼優(yōu)化設計，則可降低異步干擾信號對系統性能的影響，從而改善系統性能。
- 關(guān)鍵字： 及其 編碼 設計 特性 干擾 系統 異步 協(xié)作
FPGA實(shí)現IRIG-B(DC)碼編碼和解碼的設計
- 為達到IRIG-B碼與時(shí)間信號輸入、輸出的精確同步，采用現代化靶場(chǎng)的IRIG-B碼編碼和解碼的原理，從工程的角度出發(fā)，提出了使用現場(chǎng)可編程門(mén)陣列(FPGA)來(lái)實(shí)現IRIG-B碼編碼和解碼的設計方案和體系結構，設計中會(huì )涉及到幾個(gè)不同的時(shí)鐘頻率，FPGA對時(shí)鐘的同步性具有靈活性、效率高、且功耗低?？垢蓴_性好的特點(diǎn)。結果表明，FPGA能夠確保為從設備提供同源的時(shí)鐘基準，使時(shí)鐘與信號的延遲控制在200 ns以?xún)?，從而得到了IRIG-B碼與時(shí)間精確同步的效果。
- 關(guān)鍵字： IRIG-B FPGA DC 編碼
一種網(wǎng)絡(luò )編碼和信道編碼的聯(lián)合設計
- 摘要：網(wǎng)絡(luò )編碼技術(shù)可以大幅度提高網(wǎng)絡(luò )的吞吐量和魯棒性，因此已成為近年來(lái)的研究熱點(diǎn)。在研究無(wú)線(xiàn)網(wǎng)絡(luò )中物理層網(wǎng)絡(luò )編碼技術(shù)的基礎上，提出了多址信道中一種聯(lián)合網(wǎng)絡(luò )編碼和信道編碼的設計方案。該設計利用LDPC碼和網(wǎng)
- 關(guān)鍵字： 編碼 設計 聯(lián)合 和信 網(wǎng)絡(luò )
編碼介紹
coding（編碼）
通過(guò)壓縮文件將其轉換成另一格式文件，或將語(yǔ)音或視頻模擬信號改編成數字信號的過(guò)程。
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