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精確異常處理
精確異常處理 文章 進(jìn)入精確異常處理技術(shù)社區
32位嵌入式CPU中系統控制協(xié)處理器的設計
- 摘 要：系統控制協(xié)處理器是MIPS體系結構CPU中必需的一個(gè)單元模塊。它最主要的功能就是利用一系列特權寄存器記錄當前CPU所處的狀態(tài)，負責異常/中斷處理，提供指令正常執行所需的環(huán)境。本文論述了一個(gè)實(shí)現MIPS 4Kc指令集CPU中系統控制協(xié)處理器的設計，包括對特權寄存器寫(xiě)操作的實(shí)現，精確異常處理機制和全定制后端物理設計。關(guān)鍵詞：系統控制協(xié)處理器；精確異常處理；流水線(xiàn)；全定制 MIPS體系結構中的系統控制協(xié)處理器簡(jiǎn)稱(chēng)CP0，它提供指令正常執行所需的環(huán)境，進(jìn)
- 關(guān)鍵字： 嵌入式系統 單片機 系統控制協(xié)處理器 精確異常處理 流水線(xiàn) 嵌入式
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精確異常處理介紹
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