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碼速調整
碼速調整 文章 進(jìn)入碼速調整技術(shù)社區
用FPGA實(shí)現非標碼速向標準碼速的調整
- 摘要：本文主要討論了如何利用FPGA可編程芯片實(shí)現計算機輸出的異步非標碼速（如9.6k、19.2k、57.6k、115.2k、460.8k等）到其鄰近的標準碼速（如64k、128k、256k、512k）的調整，實(shí)現該數據與通用傳輸系統的適配，以便能進(jìn)行遠程監控。關(guān)鍵詞：碼速調整 FPGA 一、概述現在，利用計算機進(jìn)行異地數據采集正應用到越來(lái)越多的場(chǎng)合，如何高效而低成本地回傳數據成為一個(gè)值得討論的問(wèn)題。由于計算機輸出的數據一般都是異步數據，而且碼率與通信的標準碼率也不一致，如果要利用現有的電信網(wǎng)絡(luò )進(jìn)行傳輸，
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碼速調整介紹
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