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抽象級別
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Verilog HDL基礎知識3之抽象級別
- Verilog可以在三種抽象級別上進(jìn)行描述：行為級模型、RTL級模型和門(mén)級模型。行為級（behavior level）模型的特點(diǎn)如下。1、它是比較高級的模型，主要用于testbench。2、它著(zhù)重于系統行為和算法描述，不在于系統的電路實(shí)現。3、它不可以綜合出門(mén)級模型。4、它的功能描述主要采用高級語(yǔ)言結構，如module、always、initial、fork/join/task、function、for、repeat、while、wait、event、if、case、@等。RTL級（register tr
- 關(guān)鍵字： FPGA verilog HDL 抽象級別
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抽象級別介紹
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歡迎您創(chuàng )建該詞條，闡述對抽象級別的理解，并與今后在此搜索抽象級別的朋友們分享。 創(chuàng )建詞條
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