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protel技術(shù)大全 學(xué)習protel常見(jiàn)問(wèn)題匯總

  • 1.原理圖常見(jiàn)錯誤：(1)ERC報告管腳沒(méi)有接入信號：a.創(chuàng )建封裝時(shí)給管腳定義了I/O屬性;b.創(chuàng )建元件或放置元件時(shí)修改了不一致的grid屬性，管腳與線(xiàn)沒(méi)有連上;c.創(chuàng )建元件時(shí)pin方向反向，必須非pin name端連線(xiàn)。(2)元件跑到
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PROTEL技術(shù)大全之第五篇

  • 問(wèn)：一個(gè)問(wèn)題:填充時(shí),假設布線(xiàn)規則中間距為20mil,但我有些器件要求100mil間距,怎樣才能自動(dòng)填充?復：可以在design-->rules-->clearance constraint里加問(wèn)：在protel中能否用orcad原理圖復：需要將orcad原理圖生成pro
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PROTEL技術(shù)大全之第四篇

  • 問(wèn)：如何將一塊實(shí)物硬制版的布線(xiàn)快速、原封不動(dòng)地做到電腦之中？復：最快的辦法就是掃描，然后用BMP2PCB程序轉換成膠片文件，然后再修改，但你的PCB精度必須在0.2MM以上。BMP2PCB程序可在21IC上下載，你的線(xiàn)路板必須
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PROTEL技術(shù)大全之第三篇

  • D2-D1)過(guò)孔的寄生電容會(huì )給電路造成的主要影響是延長(cháng)了信號的上升時(shí)間，降低了電路的速度。舉例來(lái)說(shuō)，對于一塊厚度為50Mil的PCB板，如果使用內徑為10Mil，焊盤(pán)直徑為20Mil的過(guò)孔，焊盤(pán)與地鋪銅區的距離為32Mil,則我們
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PROTEL技術(shù)大全之第二篇

  • 輸入網(wǎng)表時(shí)，設計規則已隨網(wǎng)表輸入進(jìn)PowerPCB了。如果修改了設計規則，必須同步原理圖，保證原理圖和PCB的一致。除了設計規則和層定義外，還有一些規則需要設置，比如Pad Stacks，需要修改標準過(guò)孔的大小。如果設計者
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PROTEL技術(shù)大全之第一篇

  • 1.原理圖常見(jiàn)錯誤：（1）ERC報告管腳沒(méi)有接入信號：a. 創(chuàng )建封裝時(shí)給管腳定義了I/O屬性；b.創(chuàng )建元件或放置元件時(shí)修改了不一致的grid屬性，管腳與線(xiàn)沒(méi)有連上；c. 創(chuàng )建元件時(shí)pin方向反向，必須非pin name端連線(xiàn)。（2）元
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