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大帶寬
大帶寬 文章 進(jìn)入大帶寬技術(shù)社區
基于FPGA的一種DDR4存儲模塊設計
- 5G通信的主要特征包括“高速率、大帶寬”，為了滿(mǎn)足高速率、大帶寬數據的傳輸要求，需要一種存儲技術(shù)對數據進(jìn)行存儲。本文就存儲技術(shù)結合DDR4協(xié)議，設計了一種DDR4傳輸機制，本研究采用高性能的XCVU9P系列的FPGA芯片作為控制芯片，使用其內部自帶的DDR4 SDRAM（MIG）IP核進(jìn)行例化核設計。經(jīng)過(guò)驗證，實(shí)現在250 MHz時(shí)鐘下對DDR4 SDRAM的讀/寫(xiě)操作，數據無(wú)丟失，能夠保證高速率、大帶寬數據正常傳輸，該傳輸機制具有良好的可靠性、適用性及有效性。
- 關(guān)鍵字： DDR4 高速率 大帶寬 FPGA 202108
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大帶寬介紹
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