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EEPW首頁(yè) >> 主題列表 >> 壓穩態(tài)

理解FPGA中的壓穩態(tài)

  • FPGA 設計人員可以通過(guò)增大tMET ，采用增加同步寄存器時(shí)序余量等設計方法來(lái)提高系統可靠性，增大亞穩態(tài)MTBF。Altera 確定了其 FPGA 的MTBF 參數，改進(jìn)器件技術(shù)，從而增大了亞穩態(tài)MTBF。使用Altera FPGA 的設計人員可以利用Quartus II 軟件功能來(lái)報告設計的亞穩態(tài)MTBF，優(yōu)化設計布局以增大MTBF。
  • 關(guān)鍵字： 壓穩態(tài)  MTBF  FPGA  

理解FPGA中的壓穩態(tài)及計算壓穩態(tài)的方法

  • 本白皮書(shū)介紹FPGA中的壓穩態(tài)，為什么會(huì )出現這一現象，它是怎樣導致設計失敗的。介紹怎樣計算壓穩態(tài)MTBF，重...
  • 關(guān)鍵字： FPGA  壓穩態(tài)  MTBF  寄存器  

理解FPGA 中的壓穩態(tài)

  • 理解FPGA 中的壓穩態(tài) 本白皮書(shū)介紹FPGA 中的壓穩態(tài)，為什么會(huì )出現這一現象，它是怎樣導致設計失敗的。介紹怎樣計算壓穩態(tài)MTBF，重點(diǎn)是對結果造成影響的各種器件和設計參數。
    引言
    當信號在不相關(guān)或者異步時(shí)鐘域
  • 關(guān)鍵字： FPGA  壓穩態(tài)    
共3條 1/1 1

壓穩態(tài)介紹

您好，目前還沒(méi)有人創(chuàng )建詞條壓穩態(tài)!
歡迎您創(chuàng )建該詞條，闡述對壓穩態(tài)的理解，并與今后在此搜索壓穩態(tài)的朋友們分享。    創(chuàng )建詞條

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