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EEPW首頁(yè) >> 主題列表 >> 協(xié)同處理

協(xié)同處理文章進(jìn)入協(xié)同處理技術(shù)社區

FPGA與DSP協(xié)同處理系統設計之：典型實(shí)例-整數DCT變換的設計與實(shí)現

本節旨在設計實(shí)現了視頻壓縮標準H.264算法中的整數DCT變換部分，幫助讀者了解并行流水設計技巧在算法優(yōu)化中的作用。
關(guān)鍵字： DSP 協(xié)同處理 FPGA 整數DCT變換 H.264

FPGA與DSP協(xié)同處理系統設計之：典型實(shí)例-FPGA片上硬件乘法器的使用

在FPGA+DSP系統設計系統中，FPGA經(jīng)常作為DSP的協(xié)處理器來(lái)輔助完成一些計算任務(wù)。而這些計算工作中最消耗時(shí)間的就是乘法運算，因此本實(shí)例的主要內容就是幫助讀者學(xué)會(huì )調用硬件乘法IP核。
關(guān)鍵字： DSP 協(xié)同處理 FPGA 硬件乘法器

FPGA與DSP協(xié)同處理系統設計之：FPGA+DSP協(xié)同平臺的調試技巧和注意事項

作為雙芯片的協(xié)同系統，調試的開(kāi)始階段需要對每個(gè)芯片進(jìn)行單獨測試。這種情況下就需要避免另外一個(gè)芯片對調試產(chǎn)生影響，比較好的辦法就是讓它停止工作。
關(guān)鍵字： DSP 協(xié)同處理 FPGA 內部邏輯分析儀隔離調試

FPGA與DSP協(xié)同處理系統設計之： FPGA與DSP的通信接口設計

以上的接口中，比較常用的接口是EMIF和HPI。其中總線(xiàn)接口需要協(xié)議支持，開(kāi)發(fā)難度較大，串行接口開(kāi)發(fā)簡(jiǎn)單，但是速率較慢。VPORT等特殊接口一般是在特定的場(chǎng)合下應用，不具備通用性，而且需要修改DSP驅動(dòng)，開(kāi)發(fā)周期較長(cháng)。
關(guān)鍵字： DSP 協(xié)同處理 FPGA 通信接口 EMIF HPI BlockRAM

FPGA與DSP協(xié)同處理系統設計之：基于FPGA+DSP協(xié)同處理平臺的優(yōu)勢和適用領(lǐng)域

FPGA的一個(gè)重要的應用領(lǐng)域就是數字信號處理，隨著(zhù)FPGA密度和速度的提高，現在FPGA已經(jīng)可以勝任一些原來(lái)只有專(zhuān)用芯片或者多DSP才能完成的計算任務(wù)。
關(guān)鍵字： DSP 協(xié)同處理 FPGA

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協(xié)同處理介紹

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