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加解密協(xié)處理器
加解密協(xié)處理器 文章 進(jìn)入加解密協(xié)處理器技術(shù)社區
高速可配置RSA密碼協(xié)處理器的ASIC設計
- 提出了一種基于嵌入式系統的高速、可配置RSA密碼協(xié)處理器的ASIC設計方案，可實(shí)現256 bit到2 048 bit的RSA加密運算。為了提高運算速度，采用改進(jìn)的高基模乘算法和流水線(xiàn)結構；為了消除協(xié)處理器與內存之間的通信速度瓶頸，使用DMA直接訪(fǎng)問(wèn)方式；同時(shí)，數據輸入輸出都使用雙口存儲體，形成加解密數據流，本文將該加解密協(xié)處理器簡(jiǎn)稱(chēng)為SPU（Streaming Processing Unit）。
- 關(guān)鍵字： 加解密協(xié)處理器 ASIC設計 蒙哥馬利乘法
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加解密協(xié)處理器介紹
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