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FPGA協(xié)處理器實(shí)現代碼加速的設計

  • 本文主要研究了代碼加速和代碼轉換到硬件協(xié)處理器的方法。我們還分析了通過(guò)一個(gè)涉及到基于輔助處理器單元(APU)的實(shí)際圖像顯示案例的基準數據均衡決策的過(guò)程。該設計使用了在一個(gè)平臺FPGA中實(shí)現的一個(gè)嵌入式PowerPC。
  • 關(guān)鍵字： 協(xié)處理器  代碼加速  HDL  
共1條 1/1 1

代碼加速介紹

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