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EEPW首頁(yè) > 嵌入式系統 > 設計應用 > 抗SEU存儲器的設計的FPGA實(shí)現

抗SEU存儲器的設計的FPGA實(shí)現

作者： 時(shí)間：2010-11-21 來(lái)源：網(wǎng)絡(luò ) 收藏

本文引用地址：http://dyxdggzs.com/article/151322.htm

　　5 結束語(yǔ)

　　本設計中的抗SEU存儲器的設計可通過(guò)ACTEL的ProAsic系列A3P400 FPGA實(shí)現，并可使用與其配套的Liber08.5 EDA工具進(jìn)行代碼的編輯和原理圖的繪制，并進(jìn)行功能仿真與電路的綜合。通過(guò)仿真可以看到，本設計可以達到預期的目的，它既可實(shí)現存儲器的抗SEU設計，又可以滿(mǎn)足對存儲器使用靈活性的要求，而且具有功能完善、適應性強、電路簡(jiǎn)單等特點(diǎn)，非常適用于星載RAM的抗輻射電路設計。
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關(guān)鍵詞： 實(shí)現 FPGA 設計 存儲器 SEU

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